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北航计算机组成实验Project4
Project4 VerilogHDL完成
单周期
处理器开发 适合北航计算机系的学生 1.处理器应 MIPS-Lite3 指令集。 a) MIPS-Lite3={MIPS-Lite2,addi,addiu, slt,j,jal,jr}。 b) MIPS-Lite2 指令集:addu,subu,ori,lw,sw,beq,lui。 c) addi 可以不支持溢出。 2. 处理器为
单周期
设计。
2019-12-21 18:55:54
776KB
北航
计算机组成
Project4
单周期处理器
1
单周期
CPUverilog实现
华科,
单周期
CPUverilog实现,
单周期
CPUverilog实现,可供参考,hhh。
2019-12-21 18:54:37
10KB
CPU
verilog
1
单周期
CPUMIPS32位
单周期
CPU 32位MIPS
单周期
CPU 可以实现16条指令
MIPS32位
单周期
CPU 32位MIPS
单周期
CPU 可以实现16条指令
2019-12-21 18:53:48
19KB
MIPS32位
1
Logisim Mips
单周期
处理器
电路模拟logisim进行mips
单周期
CPU开发,支持的指令集MIPS-Lite:addu,subu,ori,lw,sw,beq,lui,j,sb
2019-12-21 18:53:28
181KB
logisim
mips
1
单周期
CPU的Verilog实现
单周期
CPU,实现了lw,sw,add,sub,slt,jmp指令
2019-12-21 18:49:43
1.72MB
单周期
Verilog
计组
体系
1
单周期
CPU代码实现
北航计算机组成课程设计
单周期
CPU的Verilog代码实现,内包含源代码和相应的测试文件
2019-12-21 18:48:19
13KB
单周期CPU
1
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