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基于FPGA的卷积码译码器的方案
本文基于FPGA技术设计了一种(2,1,8)卷积码的硬判决维特比译码器。该译码器以FPGA片内的寄存器作为路径度量和幸存路径的存储单元,经分析得出了路径度量单元的最小位宽,有效降低了对芯片资源的消耗。采用截短译码算法,降低了硬件的复杂度。采取了一种巧妙的方法实现了译码器的启动过程单元。
2022-05-05 15:44:45
73KB
FPGA
卷积码译码器
寄存器
路径度量
1
BPSK,QPSK,8PSK,4QAM,16QAM,五种调制方式下的球形译码算法的MATLAB仿真,matlab2013b仿真。
BPSK,QPSK,8PSK,4QAM,16QAM,五种调制方式下的球形译码算法的MATLAB仿真,matlab2013b仿真。
2022-05-04 17:17:35
40KB
matlab
算法
开发语言
球形译码
哈夫曼编码及其译码的实现
用C++实现的哈夫曼编码及其译码,功能较全,可以对自己输入的内容进行编码也可对输入的密文进行译码
2022-05-03 20:04:11
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2022-05-03 19:48:16
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2022-05-03 16:01:03
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基于biBM译码算法的RS解码器,需要这一方面程序的可以参考使用,是matlab程序
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源码软件
matlab
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文档资料
安全
网络
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结合低密度奇偶校验码(LDPC)的译码算法和最新的现场可编程门阵列(FPGA)技术,提出了一种对低密度 奇偶校验码的最小和算法(MSA)进行C 语言现场可编程门阵列编程实现的新方案。基于Xilinx 公司的Virtex2 系列芯片 XC2V2000,设计实现了一种码长为250,码率为0.5 的(3,6)低密度奇偶校验码译码器,并给出了寄存器传输级(RTL)协同 仿真系统结构,证实了低密度奇偶校验码具有良好的纠错性能,为软件工程师开发基于现场可编程门阵列的嵌入式系统提供 了新的思路。
2022-05-01 10:55:17
1.05MB
LDPC
FPGA
1
chase译码算法
matlab编程算法,硬译码,chase译码
2022-04-30 20:02:18
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硬译码、chase译码
1
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