mash_111 PLL小数分频
2021-08-04 22:00:47 4KB verilog 前端
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永磁同步电机(PMSM)的无传感器磁场定向控制+PLL永磁同步电机(PMSM)的无传感器磁场定向控制+PLL永磁同步电机(PMSM)的无传感器磁场定向控制+PLL
2021-08-03 11:26:03 1.83MB 无感控制
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HAL库配置 ADF4351 pll锁相环, 简介代码,可控制频率
2021-08-03 09:31:47 40.29MB stm32 pll 锁相环
此资源主要为Cyclone IV的pll_reconfig使用范例,利用pll_reconfig实现时钟的动态配置,其详细的配置步骤可参考我的这篇博客https://blog.csdn.net/qq_44810239/article/details/109522470,此外里面还包含有Cyclone IV的器件手册中文版以及官方的pll_reconfig使用指南
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很多初学者看到板上只有一个 50Mhz 时钟输入的时候都产生疑惑,时钟怎么才 50Mhz?如果 要工作在 100Mhz、 150Mhz 怎么办?在很多 FPGA 芯片内部都集成了 PLL,其他厂商可能丌叫 PLL, 但是也有类似的功能模块,通过 PLL 可以倍频分频,产生其他很多时钟。 本实验通过调用 PLL ip core 来学习 PLL 的使用、 ISE 的 IP core 使用方法。
2021-07-27 09:49:13 1.44MB ax309
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基于MATLAB/Simulink 滑动傅立叶变换与D-Q轴解耦的三相PLL锁相环对比仿真模型
2021-07-18 09:02:39 869KB MATLAB/Simulink 滑动傅立叶 SFT PLL
PLL的matlab建模源代码 PLL的matlab建模源代码
2021-07-12 11:05:50 11KB PLL matlab 建模 源代码
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对RFFC5071 RFFC5072 内部寄存器进行了定义,支持功能位段操作,方便开发。
2021-07-07 17:23:26 2KB RFFC5071 RFFC5072 PLL MIXER
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Altera可重配置PLL手册(中文),推荐给大家。
2021-07-06 10:13:32 1.28MB Altera 可重配置 PLL手册
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模型是自己根据论文搭建的simulink仿真,并且能正确的锁相,SOGI能起到滤除谐波作用
2021-07-06 09:02:54 25KB SOGI PLL 永磁同步电机
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