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基于cordic算法的吉文斯迭代的
定点
QR分解在FPGA的实现
介绍了一种基于cordic算法的no除法器no开方no乘法的在FPGA上实现的QR分解方法。挺有意思。
2020-01-03 11:34:45
265KB
QR分解
1
定点
原码一位除法器-组成原理课设
计算机组成原理,
定点
原码一位除法器的设计。报告中
2020-01-03 11:21:52
421KB
定点原码一位除法器
计算机组成原理
1
Verilog利用IP核实现
定点
转浮点运算
Verilog利用IP核实现
定点
转浮点运算,quartus直接调用ip,内附有modulesim仿真测试模块,testbench文件和仿真波形
2019-12-24 03:33:00
3.12MB
Verilog
IP核
1
定点
补码一位乘法器的设计 计算机组成原理课程设计 报告加工程
定点
补码一位乘法器的设计 计算机组成原理课程设计 可硬件下载
2019-12-21 22:18:46
257KB
定点补码一位乘法器的设计
计算机组成原理课程设计
1
matlab实现十进制到二进制
定点
有符号补码小数的转换
matlab实现十进制到二进制
定点
有符号补码小数的转换,其中
定点
小数的整数部分位长和小数部分位长可以自己指定,输出的最高位表示符号位(0为整数,1为负数),补码表示
2019-12-21 22:16:03
683B
matlab
十进制
二进制
有符号
1
测角交会
定点
(包括前方交会和后方交会,完整C#+VS项目)
C#+VS2017编写,完整项目,打开即用。包括前方交会和后方交会,可视化界面,表格存放数据。
2019-12-21 22:15:37
218KB
前方交会
后方交会
交会定点
C#
1
组原课设-加减交替法
定点
原码一位除法器设计
计算机组成原理课程设计 加减交替法
定点
原码一位除法器
2019-12-21 22:09:09
946KB
计算机
组成原理
加减交替法
定点原码一位
1
2400bps MELP语音编解码器-
定点
算法C语言源程序
2400bps MELP语音编解码器
定点
算法C语言源程序 可以在PC上执行
2019-12-21 22:05:29
162KB
MELP
2400
语音编解码
1
《TMS320C6655 和 TMS320C6657
定点
及浮点数字信号处理器》中文手册
《TMS320C6655 和 TMS320C6657
定点
及浮点数字信号处理器》中文手册
2019-12-21 20:52:13
28.64MB
DSP
1
定点
化参考资料
Fixed-Point to Fixed-Point Conversion,还有一个PPT,部分内容是浮点和
定点
的转化。
2019-12-21 20:51:05
2.11MB
定点化
1
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