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uC/OS_II2.51+win10+VC6.0:可完美运行于WIN10(64位)+VC6.0下的uC/OS_II，请放心使用！，其他很多在WIN10(64位)+VC6.0下都只能正确编译但却无法进行多任务切换。内附可在WIN10(64位)下运行的VC60安装包。

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μC_OS-II内核相关的分析、移植与驱动程序开发，资料的内容与书配套。

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南华大学陈教授的数字信号处理滤波器课程设计，章节包括：数字滤波器的设计及仿真、数字滤波器的实现结构对其性能影响的分析、数字滤波器参数字长对其性能指标的影响的分析。文件里仅包含最后经陈教授审核过的PDF文档，欢迎南华电气学子以此为参考。

在CoolRunner-II器件的每个功能块中有16个独立的宏单元，每个宏单元由触发器、多路选择器及时钟资源等构成，如图1所示。 　　 图1 CoolRunner-II宏单元结构　　宏单元中的触发器可以构成普通的触发器、锁存器和双沿触发器（DualEDGE），双沿触发器的使用及丰富了CoolRunner-II的应用，节省了逻辑资源。例如利用双沿触发器可构成时钟的倍频器、移位寄存器、计数器及脉宽调制器（PWM）等，如图2所示。一般情况下，在普通的CPLD器件中使用触发器来实现信号的倍频功能需要占用较多的资源。 　　图2  CoolRunner-II的DualEDGE触发器和信号输出　

有中华学习机的概述、使用技巧和维护修理等内容。中华学习机与Apple IIe兼容，并增加了中文支持，用汉卡替换了Apple IIe的80列卡。

3.7嵌入式逻辑分析仪的使用 伴随着EDA工具的快速发展，一种新的调试工具Quartus II 中的SignalTap II 满足了FPGA开发中硬件调试的要求，它具有无干扰、便于升级、使用简单、价格低廉等特点。本节将介绍SignalTap II逻辑分析仪的主要特点和使用流程，并以一个实例介绍该分析仪具体的操作方法和步骤。 3.7.1 Quartus II的SignalTap II原理 SignalTapII是内嵌逻辑分析仪，是把一段执行逻辑分析功能的代码和客户的设计组合在一起编译、布局布线的。在调试时，SignalTapII通过状态采样将客户设定的节点信息存储于FPGA内嵌的Memory Block中，再通过下载电缆传回计算机。 SignalTap II嵌入逻辑分析仪集成到Quartus II设计软件中，能够捕获和显示可编程单芯片系统（SOPC）设计中实时信号的状态，这样开发者就可以在整个设计过程中以系统级的速度观察硬件和软件的交互作用。它支持多达1024个通道，采样深度高达128Kb，每个分析仪均有10级触发输入/输出，从而增加了采样的精度。SignalTap II为设计者提供了业界领先的SOPC设计的实时可视性，能够大大减少验证过程中所花费的时间。