包含典型电路源码,SPI,I2C,clk_div,等等。方便verilog初学者学习
2021-06-20 20:39:11 7.08MB verilog source code
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其中包括: FPGA&ASIC笔面试题船新版本 IC厂面试经验(面试经验都在这个pdf里) 2018汇顶笔试 2019大疆笔试 AMBA-AXI3-v1.0协议中文完整翻译 ASIC前后端设计经典的细节讲解 FIFO Simulation and Synthesis Techniques for AsynchronousFIFO Design 复旦微2017年校招笔试题 跨时钟域设计 2020年乐鑫提前批数字IC设计岗 2020年联发科笔试 路科笔试真题完整版1.5.1 你要的FPGA&数字前端笔面试题都在这儿.pdf 综合与Design Compiler(很好)
2021-06-18 19:17:13 45.16MB 数字IC前端 IC设计 芯片设计 笔试面试题
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静态时序分析.ppt
2021-06-18 01:44:05 1.29MB 静态时序分析.ppt 数字IC
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设计与验证基础 脚本 笔面试题集 rtl_code 状态机设计 异步FIFO设计 亚稳态的世界 信号处理 同步FIFO设计 通信方式与仿真 速度与面积的优化 时钟域与时钟树 时钟与复位 时钟分频技术 时钟约束 全局时钟 流水线的艺术 基础知识题集 多时钟处理 低功耗设计 存储单元与模块 verilog语法知识 FPGA内部结构 ...
2021-06-15 16:42:05 616.57MB 数字IC 芯片设计 数字前后端
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PXI数字模式仪器,100M,功能类似于NI PXIe-6570,chroma 33010,成熟应用,测试厂稳定运行多年,高性价比
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systemverilog官方文档
2021-06-08 18:04:47 8.64MB 数字IC设计 数字IC验证 fpga/cpld
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这个文档以一个例子,描述了数字IC设计后端[APR]的整个流程,非常具有学习的意义
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村田的数字IC的去耦,去噪声的电容应用手册,适用于电子工程师,研究生,本科生,电子爱好者等相关专业设计人员参考学习。
2021-05-10 14:02:47 3.2MB 数字电路设计 去耦滤波 硬件设计
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数字IC前端到数字IC后端的synopsysEDA自动化流程脚本,自动处理DC、FM、PT等等软件的自动处理脚本
2021-05-09 21:22:18 1.07MB 数字IC
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S家的MinSoc项目,有相关SoC、uart串口、Ethernet IP core verilog代码,以及vcs、Verdi仿真环境。通过Makefile进行仿真。其中包括后仿真、覆盖率仿真等等,适合数字IC学习。
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