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FPGA:Quartus II 13.0 IP_RAM工程及ModelSim仿真工程
1.FPGA工程,路径为/par 2.ModeSim工程,独立仿真,使用ModelSIm打开,路径为/Sim 3.有调适说明,路径为/doc
2022-06-19 22:55:54
7.83MB
fpga开发
ram
modelsim
1
基于FPGA的PWM信号发生器实验_quartus_基于FPGA的PWM波发生_fpga_
产生pwm波,实现频率可调,占空比可调,并在quartus完成测试。
2022-06-18 21:35:31
1.48MB
quartus
基于FPGA的PWM波发生
fpga
1
数字电子线路基础:3-1 Quartus II软件使用及门电路实验.docx
数字电子线路基础:3-1 Quartus II软件使用及门电路实验.docx
2022-06-17 09:00:48
1.01MB
计算机
互联网
文档
Quartus II使用modelsim过程(含testbench)
Quartus II 使用modelsim 过程 含testbench
2022-06-15 16:59:06
3MB
modelsim
quartusii
testbench
1
Quartus_13.0_x86破解器
quartus13 32位注册机,仅适用于32位系统,请确认后再下载使用
2022-06-14 15:25:05
30KB
quartus13
32位
破解
注册
1
Quartus II 13.1crack
用于Quartus II 13.1的破解,内附详细的破解文档 PS:安装完成后请选择试用打开Quartus(很重要)
2022-06-14 08:20:53
173KB
Quartus
II
13.1crack
1
基于quartus的可调时数字钟
本程序功能包括时钟计数、可调时、整点报时等。对初学FPGA的同鞋十分有用。程序本人亲自编写、测试,没问题。芯片用的是cyclone3。
2022-06-10 10:05:29
323KB
quartus
数字钟
FPGA
1
用可编程逻辑器件FPGA实现简单数字系统的设计(广工实验报告+仿真完整版+附加思考题)
设计一个多功能数字钟,要求如下: 1. 有“时”、“分”、“秒”的十进制数字显示,最大显示值为“23时59分59秒; 2. 有手动校时、较分的功能(时、分单独较正时均不影响其他部分的正常计时); 3. 任意设置的定时闹钟(用一个发光管的闪烁提示闹钟时间到)。 思考题: 可以用哪些中规模的计数器完成设计,简述之 手动时分校正电路可以有不同的方案吗?请给出电路
2022-06-09 20:19:45
1.63MB
FPGA
QuartusⅡ
多功能数字钟
定时闹钟
1
matlab产生正弦波及.mif文件的程序-其它文档类资源
matlab产生正弦波及.mif文件的程序 生成正弦波rom表,输出为.mif格式,quartus可直接调用,有详细注释
2022-06-08 21:03:15
1KB
matlab
正弦波
.mif
quartus
1
Quartus_II设计八位加法器.pdf
Quartus_II设计八位加法器.pdf
2022-06-08 20:46:49
855KB
Quartus_II设计八位加法
1
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