第四节 Questasim中覆盖率统计 在做验证的最后一步,需要输出覆盖率的报告,通过该报告,我们能够得到 当前各个文件和各个模块的覆盖率情况,从而能够修正下一步给 DUT施加的激 励。同时,该报告也是我们验证工作的一个总结和一个指标性的要求。在通常的 验证中,验证工程师需要覆盖到 95%的代码、分支以及状态。 下面我们来看看如何输出覆盖率报告。 首先,我们需要在验证工程的编译过程中加上–cover 这个参数。通过 该参数使能编译器运行过程中所有设计单元的许多覆盖率信息。这里仅介绍部分 重要的参数含义。 该参数 spec的选择为下面的一个或多个。 b—收集分支统计数据。 c—收集条件统计数据。 e—收集表达式统计数据。 s—收集状态统计数据。
2021-08-29 22:07:32 611KB Verification UVM SV Questasim
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2021-08-24 19:01:18 322KB ACL2
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2021-08-20 14:00:49 1.41MB PCIe Testing Verification
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Voxceleb1数据集中的说话人验证任务 该存储库包含使用Kaldi在Voxceleb1 [1]数据集上训练i-vector说话者识别系统的简单脚本。 它是根据Kaldi / egs / sre10上的run.sh文件修改的。 要求 卡尔迪工具包 如何使用 将所有文件移至{kaldi_root} / egs / sre10文件夹 修改run.sh文件中的数据集目录和参数以适合您的计算机。 运行run.sh文件 结果 使用voxceleb1训练数据对2048个组件GMM-UBM和600维i-vector提取器进行了训练,以进行验证任务。 与Kaldi egs上的sre10基线相比,训练参数几乎相同。 GMM-2048 CDS有效值:15.39% GMM-2048 LDA + CDS eer:8.103% GMM-2048 PLDA eer:5.446% 笔记 Voxceleb1数据集是
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2021-08-11 15:16:07 3.2MB ESL
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适用于UDEC和3DEC学习者,通过完整的工程案例,和详细的命令流解析,来一步步体会UDEC的学习方法,以及UDEC的建模计算思路。
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MENTOR GRAPHICS UVM/OVM DOCUMENTATION VERIFICATION METHODOLOGY ONLINE COOKBOOK Table of Contents Articles Introduction Cookbook/Introduction Cookbook/Acknowledgements Testbench Architecture Testbench/Overview Testbench/Build Testbench/Blocklevel Testbench/IntegrationLevel Component Agent Phasing/Overview Factory UsingFactoryOverrides SystemVerilogPackages Connections to DUT Interfaces Connect/Dut Interface SVCreationOrder Connect/SystemVerilogTechniques ParameterizedTests Connect/Virtual Interface Config/VirtInterfaceConfigDb Connect/VirtInterfacePackage Connect/VirtInterfaceConfigPkg Connect/TwoKingdomsFactory VirtInterfaceFunctionCallChain BusFunctionalModels ProtocolModules Connect/AbstractConcrete Connect/AbstractConcreteConfigDB Configuring a Test Environment Config/Overview Resources/config db Config/Params Package Config/ConfiguringSequences ResourceAccessForSequences MacroCostBenefit Analysis Components & Techniques Analysis/Overview AnalysisPort AnalysisConnections MonitorComponent Predictors Scoreboards CoverageCollectors CoverageModelSwap MetricAnalyzers PostRunPhases End Of Test Mechanisms EOT/Overview Objections Sequences Sequences/Overview Sequences/Items Transaction/Methods Sequences/API Connect/Sequencer Driver/Sequence API Sequences/Generation Sequences/Overrides Sequences/Virtual Sequences/Hierarchy Driver/Use Models Driver/Unidirectional Driver/Bidirectional Driver/Pipelined Sequences/Arbitration Sequences/Priority Sequences/LockGrab Stimulus/Signal Wait Stimulus/Interrupts Sequences/Stopping Sequences/Layering Register Abstraction Layer Registers/Overview Registers/Specification Registers/Adapter Registers/Integrating Registers/Integration Registers/Register
2021-08-03 16:35:53 9.13MB UVM OVM Verification Methodology
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