FPGA 硬件电流环 基于FPGA的永磁同步伺服控制系统的设计,在FPGA实现了伺服电机的矢量控制。 有坐标变换,电流环,速度环,位置环,电机反馈接口,SVPWM。 Verilog 一种基于FPGA的永磁同步伺服控制系统,利用FPGA实现了对伺服电机的矢量控制。这个系统涉及到坐标变换、电流环、速度环、位置环、电机反馈接口以及SVPWM等关键技术。 FPGA(现场可编程门阵列):FPGA是一种可编程逻辑器件,它由大量的逻辑门、存储单元和可编程互连组成。通过在FPGA上配置不同的逻辑电路,可以实现各种功能,包括数字信号处理、控制系统等。 永磁同步伺服控制系统:永磁同步伺服控制系统是一种用于驱动永磁同步电机的控制系统。它通过对电机的电流、速度和位置进行控制,实现对电机的精确控制和定位。 伺服电机矢量控制:伺服电机矢量控制是一种先进的电机控制技术,通过对电机的磁场矢量进行控制,实现对电机的精确控制和定位。它可以提供更高的控制精度和动态性能。 坐标变换:坐标变换是指将一个坐标系中的信号或数据转换到另一个坐标系中。在永磁同步伺服控制系统中,坐标变换常用于将电机的三相电流转换到矢量控制所需
2024-07-01 20:54:59 81KB fpga开发
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数字中频正交采样的FPGA实现
2024-05-31 13:22:50 8.74MB FPGA
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基于Intel(Altera)的Quartus II平台(复制一下就可以很方便地迁移到其他FPGA平台,如Xilinx的Vivado),使用FPGA实现 异步FIFO + 同步FIFO 的工程源码: 1、异步FIFO的设计使用指针法;同步FIFO的设计使用指针法 + 计数器法; 2、详细的设计源码;详细的仿真源码、仿真设置和仿真结果; 3、更详细的说明请参考本人博文《https://wuzhikai.blog.csdn.net/article/details/121136040》及《https://wuzhikai.blog.csdn.net/article/details/121152844》。
2024-05-22 11:34:48 41.71MB fpga开发 FIFO 同步FIFO 异步FIFO
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FPGA实现高速雷达信号脉冲压缩处理_姜文博(1).caj
2024-05-12 16:58:00 11.87MB
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Verilog AXI组件自述文件 有关更多信息和更新: : GitHub存储库: : 介绍 AXI4和AXI4精简总线组件的集合。 大多数组件的接口宽度均可完全参数化。 包括利用完整cocotb测试平台。 文献资料 axi_adapter模块 具有可设置参数的数据和地址接口宽度的AXI宽度适配器模块。 支持INCR突发类型和窄突发。 包装axi_adapter_rd和axi_adapter_wr。 axi_adapter_rd模块 具有可设置参数的数据和地址接口宽度的AXI宽度适配器模块。 支持INCR突发类型和窄突发。 axi_adapter_wr模块 具有可设置参数的数据和地址接口宽度的AXI宽度适配器模块。 支持INCR突发类型和窄突发。 axi_axil_adapter模块 具有可设置参数的数据和地址接口宽度的AXI至AXI lite转换器和宽度适配器模块。 支持IN
2024-04-25 21:09:33 397KB Verilog
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(1) 按网口探测 (2) 按 IP探测  绑定 IP/MAC地址对。其中,绑定方式有两种: (1) 探测 IP/MAC地址对后选择并绑定 (2) 手工输入 IP 与 MAC对。 探测 IP/MAC地址对 图 8-19 IP/MAC 地址探测 表 8-14 IP/MAC 地址探测项说明 域名 说明 按网口探测 IP/MAC 地址探测方式。 fe1 等网口 当前已激活的网口列表 管理员根据需求指定要做 IP/MAC 探测的网口,可以多选 按 IP 探测 IP/MAC 地址探测方式 输入框 输入 IP 地址或网段 探测 点击后,对指定网口进行 IP/MAC 地址对的探测 探测完成时,指定网口前的选择中符号消失,管理员可以点击“探测到的 IP/MAC 对”进行查看。 探测到的 IP/MAC 对 点击后,显示当前探测到的 IP,MAC 和网口的列表。
2024-04-09 14:49:57 7.17MB
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数字信号处理器的FPGA实现.pdf
2024-04-08 10:56:58 7.34MB 数字信号处理 FPGA
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之前语音采集模块用到的8通道AD转换芯片,已实现语音数据采集功能。设计采用了AD7608的并行数据传输,并在busy高时取数AD转换数据以达到最大转换速率,亲测过采样为0时最大转换速率超过200kbps。
2024-03-28 15:17:24 865KB fpga开发 verilog ad7608
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本文提出的FFT实现算法是基于FPGA之上的,算法完成对一个序列的FFT计算,完全由脉冲触发,外部只输入一脉冲头和输入数据,便可以得到该脉冲头作为起始标志的N点FFT输出结果。
2024-03-19 17:46:42 116KB FPGA FFT算法 FPGA
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RS编译码的FPGA实现研究_叶清贵,这是一篇期刊文献,但是对于编译码RS的实现有着重要的作用。适合基础小白从头开始学起。亲测有用。推荐
2024-03-15 21:46:45 2.75MB RS编译码
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