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RSA加密解密
IP核设计
开题报告
自己写的开题报告,参考了很多资料,写的不好,就不要分了,仅供参考!
2024-05-22 13:23:26
40KB
RSA
开题报告
1
基于fpga快速傅里叶变换(FFT)的
IP核设计
(含程序)
快速傅立叶变换(FFT)作为时域和频域转换的基本运算,是数字谱分析的必要前提。传统的FFT使用软件或DSP实现,高速处理时实时性较难满足。FPGA是直接由硬件实现的,其内部结构规则简单,通常可以容纳很多相同的运算单元,因此FPGA在作指定运算时,速度会远远高于通用的DSP芯片。FFT运算结构相对比较简单和固定,适于用FPGA进行硬件实现,并且能兼顾速度及灵活性。本文介绍了一种通用的可以在FPGA上实现32点FFT变换的方法。
2023-03-21 11:07:18
7.98MB
fpga
傅里叶变换(
1
Altera-LVDS的
IP核设计
详解.zip_LVDS altera_altera ip核详解_altera lvds IP_
自己总结的Altera_LVDS的IP核的设计及仿真分析,非常使用,已在实际工程中应用到
2022-11-08 08:31:07
3.04MB
lvds_altera
altera_ip核详解
altera_lvds_ip
lvds_ip
1
基于APB的uart_
ip核设计
与验证
ic设计验证,apb uart
2022-10-28 22:23:52
927KB
apb
uart
ic
1
基于FPGA的MCS-51单片机的
IP核设计
本文是基于FPGA的51单片机的IP 的设计与实现。论文从软件和硬件两个方面详细介绍了系统设计方案。
2022-08-14 09:26:25
5MB
FPGA
单片机
1
低复杂度SM4加密算法
IP核设计
.doc
低复杂度SM4加密算法
IP核设计
.doc
2022-05-29 19:06:39
1.67MB
tcp/ip
文档资料
网络协议
网络
基于MicroBlaze的AXI总线实时时钟
IP核设计
应用MicroBlaze软核作为CPU的硬件平台,在此平台上设计了基于AXI总线的通用实时时钟IP核。给出了创建IP核的过程和导入IP核的方法。介绍了实时时钟的IP核结构,给出了IP核的结构框图。介绍了实时时钟的原理,给出了实时时钟各个模块的核心代码。
2022-04-11 19:14:08
88KB
AXI总线
MicroBlaze
实时时钟
文章
1
FPGA的1553B总线编码
IP核设计
-论文
FPGA的1553B总线编码
IP核设计
2022-03-30 21:35:58
1.11MB
fpga
1553b
总线
编码
1
论文研究-基于AMBA总线的DMA控制器
IP核设计
与分析.pdf
介绍了一种设计基于AMBA总线的DMA控制器IP核的方法。用硬件描述语言(VHDL)来设计实现挂接在AMBA AHB总线上的DMA控制器,并通过可编程逻辑器件(FPGA)完成对设计的验证,最终形成可复用的IP软核,用到ASIC或FPGA中。
2022-01-27 15:22:20
245KB
DMA控制器
AMBA总线
IP
VHDL
1
基于fpga快速傅里叶变换(FFT)的
IP核设计
(含程序)
快速傅立叶变换(FFT)作为时域和频域转换的基本运算,是数字谱分析的必要前提。传统的FFT使用软件或DSP实现,高速处理时实时性较难满足。FPGA是直接由硬件实现的,其内部结构规则简单,通常可以容纳很多相同的运算单元,因此FPGA在作指定运算时,速度会远远高于通用的DSP芯片。FFT运算结构相对比较简单和固定,适于用FPGA进行硬件实现,并且能兼顾速度及灵活性。本文介绍了一种通用的可以在FPGA上实现32点FFT变换的方法。
2022-01-18 09:15:53
7.98MB
fpga
傅里叶变换(
1
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