1. 通过补充缺失代码，完成一个 5 条指令单周期 CPU 的设计与验证；
2. 通过调试并修正已有实现中的错误，完成一个 20 条指令单周期 CPU 的设计与验证；
3. 在已实现的单周期 CPU 基础上，设计一个不考虑相关引发的冲突的单发射五级 CPU，并进行仿真和验证。
软件：vivado
语言：veilog
2024-12-18 20:00:06
251.43MB
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1. 命名多长最合适
2. 利用上下文简化命名
3. 命名要可读、可搜索
4. 如何命名接口和抽象类
1. 注释到底该写什么
2. 注释是不是越多越好
2022-08-04 09:00:32
1.54MB
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mipsCPU
利用verilog硬件描述语言实现mips五级流水线CPU设计，并实现20条基本指令和其他高级指令，
2021-07-09 02:15:51
986KB
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