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FPGA实现RS-232串口收发的仿真过程
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上传者:
yss060351
|
上传时间: 2019-12-21 22:13:28
|
文件大小: 275KB
|
文件类型: doc
FPGA
串口
1. 文本程序输入(Verilog HDL) 2. 功能仿真(ModelSim,查看逻辑功能是否正确,要写一个Test Bench) 3. 综合(Synplify Pro,程序综合成网表) 4. 布局布线(Quartus II,根据我选定的FPGA器件型号,将网表布到器件中,并估算出相应的时延) 5. 时序仿真(ModelSim,根据时延做进一步仿真)
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