5个arm核 arm6_verilog核arm7_VHDL等
5个arm核arm6_verilog,arm7_verilog_1,arm7_VHDL,Core_arm_VHDL,nnARM01_11_1_3 arm6_verilog.rar 一个最简单的arm内核，verilog写的，有点乱 arm7_verilog_1.rar J. Shin用verilog写的arm7核心，结构良好，简明易懂 nnARM01_11_1_3.zip.zip nnARM开源项目，国防科技大学牛人ShengYu Shen写的，原来放在opencores上，因为写得太好了，后被ARM公司封杀~~这里是目前我能找到的最终版本了~ Core_arm_VHDL.rar VHDL语言实现的arm内核，可以在http://www.opencores.org/project,core_arm下载到，不过还不是非常完整，有些小bug ARM7_VHDL.rar Ruslan Lepetenok用VHDL写的arm内核，也非常不错
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[{"title":"（ 6 个子文件 1.1MB ） 5个arm核 arm6_verilog核arm7_VHDL等","children":[{"title":"arm core introduction.txt <span style='color:#111;'> 500B </span>","children":null,"spread":false},{"title":"arm7_verilog_1.rar <span style='color:#111;'> 60.80KB </span>","children":null,"spread":false},{"title":"nnARM01_11_1_3.zip.zip <span style='color:#111;'> 334.10KB </span>","children":null,"spread":false},{"title":"ARM7_VHDL.rar <span style='color:#111;'> 66.15KB </span>","children":null,"spread":false},{"title":"arm6_verilog.rar <span style='color:#111;'> 7.32KB </span>","children":null,"spread":false},{"title":"Core_arm_VHDL.rar <span style='color:#111;'> 753.73KB </span>","children":null,"spread":false}],"spread":true}]
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