基于FPGA的电子时钟（kehu）.zip
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qq:1391074994
1. 资料都是有论文和程序的，程序大部分是quartus的工程，有几个是ise或者vivado的工程，代码文件就是里面的V文件。
2. 我收集的每个小项目都会开源出来，欢迎关注我的博客并下载学习。
3. 每个项目的实际的项目要求和实现的现象我就不挨个去描述了，太多了！！40多个小项目。（一个包里面只有一个小项目哈）
4. 有的项目可能会有多个程序，因为用的代码有点差异，比如密码锁，就会分显示的数码管的显示个数的不同以及用的是verilog个vhdl 的差别：
5. 报告的话博客专栏里面只是展示了一小部分。链接：https://blog.csdn.net/weixin_44830487/category_10987396.html?spm=1001.2014.3001.5482
这个是8位数码管的。
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资源详情
[{"title":"（ 463 个子文件 16.07MB ） 基于FPGA的电子时钟（kehu）.zip","children":[{"title":"Digital_clock.qpf <span style='color:#111;'> 1.26KB </span>","children":null,"spread":false},{"title":"Digital_clock.qsf <span style='color:#111;'> 4.61KB </span>","children":null,"spread":false},{"title":"timing.v.bak <span style='color:#111;'> 2.56KB </span>","children":null,"spread":false},{"title":"EP4CE6E.qsf <span style='color:#111;'> 1.14KB </span>","children":null,"spread":false},{"title":"Bell.v.bak <span style='color:#111;'> 1.27KB </span>","children":null,"spread":false},{"title":"......","children":null,"spread":false},{"title":"<span style='color:steelblue;'>文件过多，未全部展示</span>","children":null,"spread":false}],"spread":true}]
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