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Verilog数字系统设计(夏宇闻) 第3版.zip
Verilog数字系统设计(夏宇闻) 第3版.zip
上传者:
42343044
|
上传时间: 2021-05-06 18:47:17
|
文件大小: 103.87MB
|
文件类型: ZIP
Verilog
VHDL
fpga
本压缩包主要是夏宇闻编写的Verilog数字系统设计,这是 第3版的课程资源的pdf版本,内容涵盖492页,带书签,字迹清晰,适合初学FPGA的人学习观看.
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评论信息
zhenbuhui :
不错,很清晰
2019-06-20
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