低功耗CMOS三值四输入全加器设计及其应用 (2011年)

上传者: 38737176 | 上传时间: 2022-03-31 01:44:47 | 文件大小: 1MB | 文件类型: -
针对传统三值全加器没有充分利用进位的不足,提出一种新型的三值四输入全加器电路结构,并用CMOS 设计这种全加器,与传统的三值三输入全加器相比,将原有的输入由3个增加到4个,将原有的进位由二值信号变为三值信号。所提出的三值四输入全加器增加了处理的信息量,提高了进位端的利用率,在较大电路设计中能减少所用加法器模块的数量,并减少所用管子数和降低芯片面积。基于该新型全加器,设计了3个四位三值数串行加法电路。经Hspice模拟,所设计的电路有正确的逻辑功能,与基于传统三值三输入全加器的设计相比,在处理信息量较大的电

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