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基于FPGA的抢答器设计与实现
基于FPGA的抢答器设计与实现
上传者:
38682054
|
上传时间: 2021-11-08 11:05:40
|
文件大小: 388KB
|
文件类型: -
FPGA
抢答器
I/O端口
文章
本设计以FPGA 为基础设计了有三组输入(每组三人),具有抢答计时控制,能够对各抢答小组成绩进行相应加减操作的通用型抢答器;本设计采用FPGA 来做增强了时序控制的灵活性,同时由于FPGA 的I/O 端口资源丰富,可以在本设计基础上稍加修改可以设计具有多组输入的抢答器。
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