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用Verilog实现阵列乘法器
用Verilog实现阵列乘法器
上传者:
u011637113
|
上传时间: 2019-12-21 21:23:18
|
文件大小: 1KB
|
文件类型: rar
Verilog
HDL
阵列
用Verilog实现阵列乘法器,采用的是流水线的做法
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评论信息
shanshan7897 :
就是个乘法器嘛,为啥说是阵列乘法器,我还以为是算矩阵乘法的呢
2016-10-24
yuwade3 :
不是像平行四边形一样规则的阵列,部分积的位数不一致,不是我想要的阵列乘法器
2016-02-24
colin0508 :
觉得还可以,也就是有点啰嗦
2015-05-26
chenmo901001 :
程序不错,配上一些讲解就好了,看不太懂
2014-10-15
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