Verilog数字钟设计实验报告

Verilog 数字时钟报告

设计一个多功能数字时钟，具有时分、秒计数显示、闹钟功能

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weixin_43958898 :

可以用来参考学习，总体不错。
2020-05-04
liangzaihaha :

需要自己做一个topmodule，而且里面还有小bug，总体参考价值不错
2015-11-23

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