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SVA_ The Power of Assertions in SystemVerilog
SVA_ The Power of Assertions in SystemVerilog
上传者:
41394155
|
上传时间: 2021-10-31 13:01:47
|
文件大小: 5.89MB
|
文件类型: -
systemverilo
Assertion
Eduard Cerny, Surrendra Dudani, John Havlicek, Dmitry Korchemny (auth.) - SVA_ The Power of Assertions in SystemVerilog-Springer International Publishing (2015)
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