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基于FPGA的CORDIC算法实现-Vivado Verilog
基于FPGA的CORDIC算法实现-Vivado Verilog
上传者:
pieces_thinking
|
上传时间: 2021-03-25 15:49:25
|
文件大小: 82.04MB
|
文件类型: 7Z
FPGA
基于FPGA的CORDIC算法实现-Vivado2018开发环境, Verilog语言编写,带TB文件,已经在ModelSim中仿真通过。
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