头歌计组运算器设计(HUST) 1-11关实验答案
有运算器设计的1-11关：复制代码，放进头歌，满分过
本实验使用 Verilog HDL 实现了单周期 54 条 MIPS 指令的 CPU 的设计、前仿真、后仿真和下板调试运行。CPU 可实现 54 条 MIPS 指令。
第1关：8位可控加减法电路设计
第2关：CLA182四位先行进位电路设计
第3关：4位快速加法器设计
第4关：16位快速加法器设计
第5关：32位快速加法器设计
第6关：5位无符号阵列乘法器设计
第7关：6位有符号补码阵列乘法器
第8关：乘法流水线设计
第9关：原码—位乘法器设计
第10关：补码—位乘法器设计
第11关：MIPS运算器设计
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