Educode单总线CPU设计实验(定长指令周期3级时序)(HUST)

上传者: m0_48878393 | 上传时间: 2021-08-03 09:24:52 | 文件大小: 537KB | 文件类型: CIRC
1 MIPS指令译码器设计 2 定长指令周期---时序发生器FSM设计 3 定长指令周期---时序发生器输出函数设计 4 硬布线控制器组合逻辑单元 5 定长指令周期---硬布线控制器设计 6 定长指令周期---单总线CPU设计 全通关(放入logisim可查看电路,改成txt可上传代码)

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评论信息

  • weixin_50189865 :
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    2021-11-25

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