FPGA采集AD信号

上传者: lzemily | 上传时间: 2019-12-21 20:15:44 | 文件大小: 16.8MB | 文件类型: rar
20M AD信号采集,核心模块是CYCLONE III,采集的同时通过485发送数据和接收数据。RX为接收,TX为发送。

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评论信息

  • panjie0949 :
    VHDL的,参考作用不大,不建议下载。
    2020-02-28

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