verilog编程实现的数字钟

数字钟

verilog编程实现的数字钟，里面有详尽的注释，整个工程直接打包，里面有波形图仿真，程序代码.v文件，可以直接下载到FPGA上运行显示，是电子线路测试实验的验收程序，扩展功能任意闹钟（手动设置时间） 12小时/24小时切换自动报整点时数（几点响/亮几下）。基本功能以数字形式显示时、分；秒的用LED小时；能手动校时、校分

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评论信息

qq_50916218 :

有用的代码，很有帮助
2021-06-03
lyj213 :

资源挺好，再次下载
2018-05-31
jiexian666666 :

感谢分享，我通过你的代码改编成了自己的作业，已经上传。希望分享给大家http://download.csdn.net/download/jiexian666666/10191074
2018-01-06
Hyperion233 :

好像没下成功
2017-12-29
缘来是你远去是我 :

非常有用的资源！
2017-12-17

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