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寄存器加法器.docx
寄存器加法器.docx
上传者:
gyhboo
|
上传时间: 2021-04-16 23:51:29
|
文件大小: 185KB
|
文件类型: DOCX
quartusII
含时序仿真、代码、RTL网表 掌握VHDL描述时序电路的方法,学会用VHDL设计4位寄存器加法器。同时电路应支持无符号数,其中复位是异步复位。要求写出VHDL代码,并导出RTL网表。最后通过时序仿真为A,B赋不同的值,以检验电路的正确,同时加深对时序电路的认识。
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