完全可综合的SPI模块verilog代码
附件有详细的设计规格书。Features
- Compatible with Motorola's SPI specifications
- Enhanced Motorola MC68HC11 Serial Peripheral Interface
- 4 entries deep read FIFO
- 4 entries deep write FIFO
- Interrupt generation after 1, 2, 3, or 4 transfered bytes
- 8 bit WISHBONE RevB.3 Classic interface
- Operates from a wide range of input clock frequencies
- Static synchronous design
- Fully synthesizable
- 130LUTs in a Spartan-II, 230 LCELLs in an ACEX
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资源详情
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评论信息
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u010104959 :只有一个14页的全英文datasheet，并没有看到代码，。2003年的文档，并没有找到所说的可综合的代码2019-11-24 -
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