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[{"title":"（ 3 个子文件 3KB ） 基于verilog HDL的存储器测试模块源码","children":[{"title":"state.v <span style='color:#111;'> 2.63KB </span>","children":null,"spread":false},{"title":"datapath.v <span style='color:#111;'> 5.19KB </span>","children":null,"spread":false},{"title":"ram_test.v <span style='color:#111;'> 1.14KB </span>","children":null,"spread":false}],"spread":true}]
评论信息
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enterdy :有些地方没注释对新手有点难懂2013-05-02 -
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rank123 :是一个存储器的test bench，比较规范，代码清晰，初学者可以容易看懂、多谢。2012-09-27
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