rs232串口通信的fpga实现

上传者: alone_l | 上传时间: 2022-05-24 19:08:12 | 文件大小: 9.57MB | 文件类型: ZIP
利用verilog语言实现串口的发送和接收,以及loopback测试。包含仿真代码。

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[{"title":"( 156 个子文件 9.57MB ) rs232串口通信的fpga实现","children":[{"title":"uart_rx.v <span style='color:#111;'> 3.18KB </span>","children":null,"spread":false},{"title":"uart_rs232_modelsim.xrf <span style='color:#111;'> 12.04KB </span>","children":null,"spread":false},{"title":"uart_rs232_run_msim_rtl_verilog.do.bak <span style='color:#111;'> 538B </span>","children":null,"spread":false},{"title":"vsim.wlf <span style='color:#111;'> 80.00KB </span>","children":null,"spread":false},{"title":"msim_transcript <span style='color:#111;'> 3.74KB </span>","children":null,"spread":false},{"title":"......","children":null,"spread":false},{"title":"<span style='color:steelblue;'>文件过多,未全部展示</span>","children":null,"spread":false}],"spread":true}]

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