DDR SDRAM读写控制模块Xilinx FPGA(已封装,带使用说明)

上传者: MRMIO | 上传时间: 2021-07-23 18:45:00 | 文件大小: 393KB | 文件类型: ZIP
封装好的DDR SDRAM读写控制模块,可以直接用的!改为了同步方式,使用简单!基于MIG但是进行了完整封装!本项目采用Verilog编写,本压缩包不仅包括模块的源代码,还附有“使用说明”、“管脚约束文件”、“宏定义文件”,可移植性好,开箱即用。网上关于Xilinx MIG这个控制DDR读写的IP核有不少帖子,但很多实际下板都不好用,本代码经过实际下板验证正常运行。

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[{"title":"( 7 个子文件 393KB ) DDR SDRAM读写控制模块Xilinx FPGA(已封装,带使用说明)","children":[{"title":"DDR Module","children":[{"title":"Mips54_LoadBoard.xdc <span style='color:#111;'> 8.04KB </span>","children":null,"spread":false},{"title":"ddr2_read_control.v <span style='color:#111;'> 1.79KB </span>","children":null,"spread":false},{"title":"Defination.vh <span style='color:#111;'> 10.07KB </span>","children":null,"spread":false},{"title":"DDR模块使用说明.pdf <span style='color:#111;'> 467.43KB </span>","children":null,"spread":false},{"title":"ddr2_wr.v <span style='color:#111;'> 6.75KB </span>","children":null,"spread":false},{"title":"sealedDDR.v <span style='color:#111;'> 3.39KB </span>","children":null,"spread":false},{"title":"ddr2_write_control.v <span style='color:#111;'> 2.92KB </span>","children":null,"spread":false}],"spread":true}],"spread":true}]

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