EPM240 CPLD开发板Verilog HDL设计实验例程15例Quartus 13.1工程+设计说明文档.zip

上传者: GJZGRB | 上传时间: 2021-03-31 16:08:05 | 文件大小: 7.64MB | 文件类型: ZIP
EPM240 CPLD开发板Verilog HDL设计实验例程15例Quartus 13.1工程+设计说明文档,例程如下: ex10_iic ex11_sram ex12_kz ex13_maxiiclk ex14_maxiiufm ex15_sim ex1_clkdiv ex2_key ex3_johnson ex4_seg7 ex5_mux ex6_module ex7_vga ex8_232 ex9_ps2

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