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Hi3516DV300
硬件设计
用户指南.pdf
Hi3516DV300
硬件设计
用户指南。主要涉及Hi3516DV300 外围电路
硬件设计
方面,仅供大家参考。
2021-06-22 07:41:35
2.68MB
海思
Hi3516
硬件开发
1
FOC电机控制软
硬件设计
及动手实践.pdf
1、简单介绍及主要电机评估板研发规划 2、低压大功率电机驱动
硬件设计
原理图讲解 3、高压大功率电机驱动
硬件设计
原理图讲解及USB隔离器设计讲解 4、低压大功率双电机驱动
硬件设计
原理图讲解 5、低压大功率电机驱动软件操作演示 6、高压大功率电机驱动软件操作演示 7、MotorControl Workbench软件调试经验分享及用软件测试电机参数 8、测试电机参数及FOC控制电机调试技巧补充说明
2021-06-21 09:43:51
4.44MB
FOC
电机控制
1
Quectel_EC600N-CN_
硬件设计
手册_V1.0.pdf
Quectel_EC600N-CN_
硬件设计
手册_V1.0.pdf
2021-06-19 21:01:47
1.38MB
EC600N
cat1
1
基于STM32蓝牙控制小车系统设计(硬件 源代码 论文).rar
基于STM32F4的蓝牙控制系统设计,软硬件源码以及论文都有的好资源,但仅限学习使用,不得用于其他用途
2021-06-19 19:04:54
20.89MB
STM32
蓝牙
小车
软硬件设计
1
大屏幕显示系统的
硬件设计
(1995年)
介绍在PC机管理下的多个大屏幕LED显示系统的硬件电路设计.每个大屏幕由一台或多台PCM专用机及扫描显示电路、驱动电路组成.整个系统所要显示的信息(图形或文字)由PC机组织、处理(数据变换)及传送,并利用PC机的“键盘命令”选择不同的显示方式.
2021-06-18 17:03:13
190KB
自然科学
论文
1
基于脉动阵列的卷积计算模块
硬件设计
针对FPGA实现卷积神经网络中卷积计算的过程中,高并行度带来长广播、多扇入/扇出的数据通路问题,采用脉动阵列来实现卷积神经网络中卷积计算模块,将权重固定到每个处理单元中,并按照输入和输出特征图的维度来设置脉动阵列的大小,最后通过Vivado高层次综合实现卷积计算模块的
硬件设计
。实验结果表明,本设计在实现1级流水化时序要求的同时,具有较低的资源占用和良好的扩展性。
2021-06-16 19:33:05
465KB
FPGA
1
Quectel_BC25_
硬件设计
手册_V1.1.pdf
NB模组
硬件设计
手册
2021-06-15 11:01:26
1.52MB
设计手册
1
Quectel_BC35-G_
硬件设计
手册_V1.3.pdf
BC35-G_
硬件设计
手册
2021-06-15 11:01:26
1.04MB
硬件设计
1
Quectel_BC95_R2.0_
硬件设计
手册_V1.2.pdf
硬件设计
手册
2021-06-15 11:01:26
1.09MB
硬件设计
1
Quectel_BG77_Hardware_Design_V1.1.pdf
硬件设计
手册
2021-06-15 11:01:25
1.56MB
硬件设计
1
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