Verilog 编写的UART核,可以实现可定义形式数据的收到,测试工作正常
2019-12-21 20:43:15 6.45MB Verilo UAR RS23
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经测试可以正确收发,而且用比较少的资源实现,非诚适合在小芯片或者资源比较少的开发芯片上设计与实现!
2019-12-21 20:42:00 3.34MB uart veriog
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本人自己编写的FPGA异步串口通信模块(UART),基于QUARTusII环境,verilog语言编写,包含仿真和全部程序及说明,验证通过,具有很好的稳定性和参考价值!
2019-12-21 20:41:03 2.16MB FPGA UART
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附件是RN8209C初始化及UART通讯参考程序。(就是一个.C文件)
2019-12-21 20:40:06 7KB RN8209C 串口
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基于FPGA-VERILOG语言的DS18B20温度检测,电脑串口可控制:开关数码管、开关温度转换、设置温度报警范围、开关温度报警、上传当前测量的温度值(转换前与转换后),另外不用串口控制也可以用六位数码管直接显示当前温度值
2019-12-21 20:39:18 16.05MB FPGA Verilog DS18B20 uart
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使用verilog HDL语言编写的串口IP核,其中的全部代码,经过波形仿真验证,内附说明文档,已经过仿真,可完美运行。
2019-12-21 20:39:03 1.75MB verilog uart ip核
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使用verilog实现基于FPGA的串口收发模块,可在模块内部更改波特率,收发通道独立
2019-12-21 20:36:55 3KB UART FPGA Verilog
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常用接口的FPGA程序,用ISE打开工程文件即可,包括CAN,ETH,IIC,IWBBUSCHANGE,UART,USB,VGA.
2019-12-21 20:33:09 1.85MB can eth iic uart
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用veriog语言实现的UART串口,波特率9600,8数据位,1停止位,无校验。vivado2015.2 + basys3 FPGA开发板正常运行。板子不停向上位机循环发送12,34。上位机发送一字节数据可以控制板上8个小灯亮灭。
2019-12-21 20:32:44 3KB veriog UART
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STM32F030C8T6 UART 程序源代码,通过USART2通讯,收发都OK。
2019-12-21 20:28:59 21.71MB STM32F030C8T UART
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