166MHz的SDRAM控制器,经过仿真和综合验证。该IP核是一种用于嵌入式系统的可定制化控制器,设计用于管理同步DRAM(SDRAM)芯片。具有灵活性,可实现高速数据传输,并且适用于不同类型的SDRAM。
2023-04-26 14:46:16 85.99MB Verilog 数字IC设计 SDRAM控制器
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IC设计基础,简明全面的微电子类设计开发教程,
2023-04-23 14:40:33 6.06MB IC设计
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RTL(Register Transfer Level)设计 利用硬件描述语言,如verilog,对电路以寄存器之间的传输为基础进行描述 综合: 将RTL级设计中所得的程序代码翻译成实际电路的各种元器件以及他们之间的连接关系,可以用一张表来表示,称为门级网表(Netlist)。 STA(Static Timing Analysis,静态时序分析): 套用特定的时序模型(Timing Model),针对特定电路分析其是否违反设计者给定的时序限制(Timing Constraint) 整个ASIC设计流程都是一个迭代的流程,在任何一步不能满足要求,都需要重复之前步骤,甚至重新设计RTL代码。 模拟电路设计的迭代次数甚至更多。。。
2023-04-18 13:39:45 1.54MB 综合文档
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水表软件安装与说明 目录 第一章:安装与驱动 1.1 读卡器驱动与安装 1.2 测试读卡器是否建立连接 1.3安装水表软件 第二章: 软件首次运行 2.1首次运行的工号与密码 第三章:新户开户 第四章:票据的格式 第五章:日常购水 第六章:系统设置 密码重置 初始参数设置 读卡器的设置 子表设置 硬件参数设置 用户类型设置 收费单位设置 第七章:价格管理 第一章:安装与驱动 1.1在安装过程中,选中此图标 并双击打开,然后在该目录选中此图表 并双击打开该文件进行安装。 1.2安装完成以后重新启动计算机。在选中文件 安装。然后退到桌面选中 打开所有程序在该目录中找到 MWURDP 12 选中Demo进行读卡器测试是否建立连接。 1.3在安装水表软件过程中选中 进行全部解压。 第二章 软件首次运行 2.1本软件解压完成以后无须在进行安装,请打开目录后,找到 图标; 2.2首次登入工号为“1001”;密码为“Admin”(请区分大小写); 2.3首次运行该软件的授权密码如下图(***********)请告知我方工程师; ( 3-3-1) 2.4我们做一定记录后,将发给您正式序列号给您,请您收到授权密码复制到该密码框内点击【确定】即可! (3-3-2) 看到以上图标您就可以开始正常运行该软件了。 第三章 新开用户 (4-4-1) 菜单功能:提供新开户子表注册和新用户的基本信息。 操作功能: 1)首先点击【读卡】,确保插入读卡器的为新卡,再读卡过程中会弹出下面界面;如下图(4-4-2)
2023-04-18 11:59:00 42.27MB 电表管理系统 ic卡
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IC-MHL200技术手册,完全中文翻译,可对照英文邦族阅读
2023-04-17 17:52:33 1.61MB 器件手册
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个人在学习Verilog入门的时候 用的是夏奶奶的书 可遗憾的是直到读完了还是对可综合代码与不可综合代码理解不深 而当读完这本书觉得完全避免了这个困扰 所以强烈推荐刚学习Verilog和想学习Verilog的同学采用这本书作为参考 它让学习的时候更加贴近工程设计 是个不错的选择
2023-04-15 13:58:25 4MB Verilog IC设计 实例详解
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IC集成电路应用手册全书共分10章。内容包括:晶体管的版图设计,组合逻辑和时序逻辑的门级电路设计,子电路系统及其芯片的版图布局、布线技术,芯片的体系结构以及CAD算法及可测性设计等。每章末尾均附有难度不同的习题。附录中还提供了丰富而实用的词汇表。
2023-04-15 09:37:52 13.92MB IC集成电路应用手册
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cadence中蒙特卡洛仿真教程
2023-04-14 15:13:25 436KB cadence 模拟IC 蒙特卡洛仿真
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芯片失效分析流程及方法,EMMI、OBIRCH、InGaAs等工作原理及应用。
2023-04-14 14:23:48 4.02MB IC Failure Analysis OBIRCH
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2023-04-13 12:13:36 91.16MB 芯片 IC 半导体
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