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数字IC前端复习过程的部分归类链接（跨时钟域，同步电路，异步电路，FIFO，FSM等）（链接文档是github的readme格式），持续更新中，外加部分电子版书籍和笔试题目

刚刚找出了几个BUG，更新了系统的版本！！ 刚刚找出了几个BUG，更新了系统的版本，欢迎“举报”BUG！！ 1、本系主要为从事金融IC及POS终端开发的人员或业务人员理解PBOC2.0 EMV等规范卡交易流程而开发，界面操作简单，有终端属性配置及日志，结果管理功能，本版本是2.2.2.1，3.0以上的版会支持EMV及Q部分，EC等卡的交易。 2、系统有附上联机时发卡行的模拟程序，有兴趣的朋友可以自己写，接口采用TCP/IP协议，可用自己编写Socket Server终端程序,端口及IP地址在终端配置,报文格式为: 70(模版) + (后续长度) + 5A（主帐号标识） + Len(5A长度) + Data(5A数据) + 5F34（主帐号应用序列号）+ Len（5F34长度）+ Data(5F34数据) + 98（ARQC计算输入数据标识）+ Len(98数据长度) + Data（98数据）+ 99(ARQC标识) + Len(ARQC数据长度) + Data（ARQC数据） 如:70 42 5A 08 6228000100001117 5F34 01 01 98 28 000521466600000000000000015600800088000156111102007F157F157D00004803A42002800000 99 08 56A0E280E4ABABC7 因为只是模拟，所以做得比较简单，是从别的程序移过来的，所以会有很多BUG，建议每次只连接一个客户端。 注：本系统只用作技术交流用，如用于有关违反法律法规均与本人无关。

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166MHz的SDRAM控制器，经过仿真和综合验证。该IP核是一种用于嵌入式系统的可定制化控制器，设计用于管理同步DRAM（SDRAM）芯片。具有灵活性，可实现高速数据传输，并且适用于不同类型的SDRAM。

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RTL（Register Transfer Level）设计 利用硬件描述语言，如verilog，对电路以寄存器之间的传输为基础进行描述 综合： 将RTL级设计中所得的程序代码翻译成实际电路的各种元器件以及他们之间的连接关系，可以用一张表来表示，称为门级网表（Netlist）。 STA（Static Timing Analysis，静态时序分析）： 套用特定的时序模型（Timing Model），针对特定电路分析其是否违反设计者给定的时序限制（Timing Constraint） 整个ASIC设计流程都是一个迭代的流程，在任何一步不能满足要求，都需要重复之前步骤，甚至重新设计RTL代码。 模拟电路设计的迭代次数甚至更多。。。

水表软件安装与说明 目录 第一章：安装与驱动 1.1 读卡器驱动与安装 1.2 测试读卡器是否建立连接 1.3安装水表软件 第二章: 软件首次运行 2.1首次运行的工号与密码 第三章：新户开户 第四章：票据的格式 第五章：日常购水 第六章：系统设置 密码重置 初始参数设置 读卡器的设置 子表设置 硬件参数设置 用户类型设置 收费单位设置 第七章：价格管理 第一章：安装与驱动 1.1在安装过程中，选中此图标 并双击打开，然后在该目录选中此图表 并双击打开该文件进行安装。 1.2安装完成以后重新启动计算机。在选中文件 安装。然后退到桌面选中 打开所有程序在该目录中找到 MWURDP 12 选中Demo进行读卡器测试是否建立连接。 1.3在安装水表软件过程中选中 进行全部解压。 第二章 软件首次运行 2.1本软件解压完成以后无须在进行安装，请打开目录后，找到 图标； 2.2首次登入工号为“1001”；密码为“Admin”（请区分大小写）； 2.3首次运行该软件的授权密码如下图（***********）请告知我方工程师； （ 3-3-1） 2.4我们做一定记录后，将发给您正式序列号给您，请您收到授权密码复制到该密码框内点击【确定】即可！ （3-3-2） 看到以上图标您就可以开始正常运行该软件了。 第三章 新开用户 （4-4-1） 菜单功能：提供新开户子表注册和新用户的基本信息。 操作功能： 1）首先点击【读卡】，确保插入读卡器的为新卡，再读卡过程中会弹出下面界面；如下图（4-4-2）