《VHDL硬件描述语言与数字逻辑电路设计》（西电版）.pdf 侯伯亨 顾新 编著

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Verilog HDL 硬件描述语言 PDF Verilog HDL 硬件描述语言 PDF

基于FPGA的智能电子密码锁设计，电子密码锁设计也是现在研究比较广泛的一类设计，里面是完整的相关设计的代码，运用的是Verilog HDL语言。

99年写的教程，比较早了。但讲得很详细。

摘 要：Verilog是广泛应用的硬件描述语言，可以用在硬件设计流程的建模、综合和模拟等多个阶段。随着硬件设计规模的不断扩大，应用硬件描述语言进行描述的CPLD结构，成为设计专用集成电路和其他集成电路的主流。通过应用Verilog HDL对多功能电子钟的设计，达到对Verilog HDL的理解，同时对CPLD器件进行简要了解。 本文的研究内容包括: 对Altera公司Flex 10K系列的EPF10K 10简要介绍，Altera公司软件Max+plusⅡ简要介绍和应用Verilog HDL对多功能电子钟进行设计。 关键词：多功能电子钟；硬件描述语言 Abstract：Verilog is the most widely used hardware description language.It can be used to the modeling, synthesis, and simulation stages of the hardware system design flow. With the scale of hardware design continually enlarging, describing the CPLD with HDL become the mainstream of designing ASIC and other IC.To comprehend Verilog HDL and get some knowledge of CPLD device, we design a block with several functions with Verilog HDL. This thesis is about to discuss the above there aspects: Introduce the EPF10K 10 of Flex 10K series producted by Altera Corporation simply. the software Max+plusⅡ,Design the block with several functions with Verilog HDL. Keywords: block with several functions; hardware description language ******************************************* 目　　录 1 引言 2 1.1课题的背景、目的 2 1.2 课题设计环境 2 2　EPF10K 10相关说明及VERILOG HDL简介 2 2.1　EPF10K 10相关说明 2 2.2 VERILOG HDL硬件描述语言简介 4 3应用VERILOG HDL描述的多功能电子钟 5 3.1功能描述 5 3.2 源程序 6 3.3模块仿真 13 4 应用VERILOG HDL描述的多功能电子钟功能模块及仿真 15 4.1 计时模块 15 4.2 闹铃设置模块 17 4.3 校时模块 19 4.4 秒表功能模块 22 4.5 整点报时模块 25 4.6 闹铃屏蔽及响铃功能 27 4.7 秒表提示铃声功能 28 5结束语 30 6致谢 30 参考文献 31

最经典的HDL语言书籍，能让你在实例和理论的结合中快速的掌握HDL语言。

VHDL（非常高速集成电路硬件描述语言）是由美国国防部支持的一项研究计划，于1983年创建，目的是以文字化方法描述电子电路与系统。

VHDL教程《集成电路设计VHDL教程》电子版：VHDL语言入门教程，适合初学者自学。教程由简及难，层次分明，其中不乏大量的例子，让初学者一目了然，是VHDL初学者不可多得的资料。

针对车载和机载卫星导航系统的数据采集问题，采用以现场可编程门阵列（Field Programmable Gate Array，FPGA）为平台的GPS导航系统数据解析方案。该设计以NMEA-0183协议的数据格式为基础，循环判断报文头、定位状态、校验位和结束位标志，根据逗号计数器的值决定提取所需要的导航信息，直至完成正确的解析。用Verilog HDL硬件描述语言完成了代码设计，并在FPGA内部生成硬件电路。仿真与硬件测试结果均表明该设计可提取导航系统中的定位信息。