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Modelsim 10.1c

Modelsim10.1c是用来编写Verilog HDL代码的IDE兼仿真平台，用于FPGA的开发

2023-01-03 09:23:37 352.82MB verilog fpga

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开源软件无线电的原理图

一个软件无线电项目 FPGA DSP AD DA

2023-01-02 22:26:40 6.19MB 软件无线电 FPGA DSP AD

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基于FPGA的简单RISC2

FPGA的一篇论文。。方便大家学习和上交毕业论文，期末论文

2023-01-02 18:33:06 195KB FPGA论文，RISC 基于FPGA

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Verilog_Frequently_Asked_Questions.pdf

verilog常见问题，看完面试不用愁，强烈推荐，绝对好书，对数字IC设计和FPGA开发都非常有用，欢迎下载

2023-01-02 18:00:13 16.96MB FPGA verilog 数字IC

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FPGA IP Cores

Quartus ii 9.0 以后的版本都可以用的IP包

2023-01-01 16:11:11 22.57MB FPGA 大学计划

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基于瑞萨MCU的BLDC设计

原理图+CODE

2022-12-31 18:11:39 213KB mcu 单片机 嵌入式硬件

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FPGA verilog语法总结

2022-12-31 13:05:36 21.12MB verilog

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Platform Flash PROM User Guide

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2022-12-31 12:05:32 1.98MB FPGA配置

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基于FPGA的简易数字时钟设计

基于FPGA的简易数字钟设计，可实现时、分、秒的led显示与调时。

2022-12-31 09:54:35 277.87MB fpga

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基于FPGA的锁相环位同步提取电路设计

同步是通信系统中一个重要的问题。在数字通信中，除了获取相干载波的载波同步外，位同步的提取是更为重要的一个环节。因为只有确定了每一个码元的起始时刻，才能对数字信息作出正确的判决。利用全数字锁相环可直接从接收到的单极性不归零码中提取位同步信号。

2022-12-30 18:29:11 101KB FPGA

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