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七分频 quartus实现 verilog

七分频 quartus实现 verilog，附有仿真波形。

2020-01-03 11:25:45 1.05MB 七分频 quartus实现 verilog

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VHDL简易交通灯设计 quartus 2

此设计为十字路口交通灯，主干道支干道各红黄绿三个信号灯分为四个状态

2020-01-03 11:25:26 3.57MB VHDL VHDL状态机 交通灯 数电课程设计

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基于QUARTUS的电子钟设计

以大规模可编程逻辑器件为载体，以硬件描述语言为系统逻辑描述为主要表达方式，以EDA开发软件为设计工具，通过有关的开发软件，自动完成用软件方式设计的电子系统到硬件系统的逻辑编译、逻辑画简、逻辑分割、逻辑综合及优化、逻辑布局布线、逻辑仿真，直至对于特定目标芯片的逻辑映射、编程下载等工作，最后形成集成电子系统或专用集成芯片的一门新技术。

2020-01-03 11:22:23 706KB 基于QUARTUS的电子钟设计

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数字频率计（EDA课程设计）

数字频率计 EDA课程设计用的和开发箱结合用的

2020-01-03 11:20:47 158KB 数字频率计 EDA Quartus

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ＥＤＡ课程设计　点阵实验

ＥＤＡ课程设计　四个模块　该压缩包包含所有的文件　下载后就可以直接提交给老师　很有用　欢迎下载

2020-01-03 11:19:25 564KB EDA VHDL QUARTUS

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FPGA实现DDS正弦波、方波、三角波发生器Verilog程序（已验证）Quartus工程文件

鉴于上次传的只有Verilog代码，怕对于像半年前的我一样的初学者仍然会遇到很大困难，现特把本人课程设计的整个Quartus工程文件一并上传，希望有用。用时只需用Quartus打开工程文件即可编译运行，频率可达16M没问题。

2020-01-03 11:19:21 16.23MB FPGA DDS 信号发生器 Quartus工程文件

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10进制计数器vhdl程序设计报告

10进制计数器 vhdl程序 quartus仿真带进位复位功能

2019-12-25 11:15:17 284KB 10进制计数器 vhdl quartus

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quartus分频模块

分频器系统模块将50mhz将至5kha，50hz

2019-12-24 03:27:25 259KB quartus

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16*16led文字显示

16*16led文字移动显示，已上板实验，可修改为自己想要文字，移动速度方向等都可修改，如有问题欢迎提问。

2019-12-23 03:32:42 6.17MB verilog quartus 16*16led

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计算结构CPU设计 verilog

自己写的代码，通过验收和后期的考试；注释清楚，可扩展性强，方便的添加指令； cpu架构绝对一级棒。

2019-12-22 20:10:10 369KB cpu verilog quartus 东南大学

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