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mini
pcie
金手指PADS封装
此文件为PADS版本的封装,可直接用PADS打开不是库文件
2019-12-21 22:15:19
46KB
mini
pcie
1
高速接口之
PCIe
一步一步开始FPGA逻辑设计 - 高速接口之
PCIe
,完整的
pcie
开发流程教程
2019-12-21 22:10:57
4.39MB
PCIe
1
PCI Express System Architecture (体系结构英文版,完整书签)
PCI Express System Architecture (体系结构英文版,完整书签)
2019-12-21 22:08:08
12.57MB
PCIE
Architecture
1
DMA技术之
PCIE
应用(XAPP1052注意点)
DMA读的操作相对复杂,需要FPGA向主机发出读请求,主机再返回数据。FPGA控制逻辑必须计算发起了多少个读TLP请求,再计算收到的数据是否足够。 一般来说FPGA可以一次发送所有的读请求,然后按照顺序接收数据即可。但是某些主板并不一定是按照请求的顺序返回数据的情况,可能后发出的请求先返回数据,属于主机乱序执行的现象。要么FPGA一次只发一个读请求,等数据收到了再发现一个读请求—但是效率就对不起了;要么对乱序情况进行特殊处理,XAPP1052还没有解决该问题。
2019-12-21 22:07:31
14KB
PCIE
DMA
1
pcie
中文详解
超级详细的
pcie
中文文档
2019-12-21 22:07:05
1.6MB
pcie
中文
1
PCI Express® Base Specification Revision 4.0, Version 1.0
This specification describes the PCI Express® architecture, interconnect attributes, fabric management, and the programming interface required to design and build systems and peripherals that are compliant with the PCI Express Specification
2019-12-21 22:06:49
18.72MB
PCIe
4.0
1.0
1
《PCI Express体系结构导读》+《armx86》(王齐)
一方面,在半导体领域,Intel继续一览众小;另一方面,ARM处理器的崭露头角正在开创一个属于更多参与者的帝国。详情请看《ARMx86》。 CI(Peripheral Component Interconnect)总线的诞生与PC(Personal Computer)的蓬勃发展密切相关。在处理器体系结构中,PCI 总线属于局部总线(Local Bus)。局部总线作为系统总线的延伸,主要功能是为了连接外部设备。
2019-12-21 22:04:42
9.33MB
PCIe、armx86
1
PCI_Express_Base_4.0
PCIE
4.0 Specification 1.0 正式版文档
最新的
PCIE
4.0文档,正式版1.0文档,PCI Express® Base Specification Revision 4.0 Version 1.0 September 27, 2017
2019-12-21 22:04:38
19.84MB
PCIE;
PCIE
4.0
1
altera
PCIE
设计指导
刚做完了一个
PCIE
项目,使用altera芯片,做一下总结。
2019-12-21 22:01:35
257KB
项目总结
1
Xilinx授权:公开全部源代码的
PCIe
DMA 引擎
这个DMA引擎在Xilinx 65nm的V5器件的
PCIe
IP上测试通过;已经在ML506 和ML555板上测试通过,欢迎大家下载使用和学习
2019-12-21 22:01:24
12.2MB
PCIe
的DMA
引擎
1
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