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一种用于高速ADC的采样保持电路的设计
设计了一个用于流水线
模数转换器(
pipelined ADC)前端的采样保持电路。该电路采用电容翻转型结构,并设计了一个增益达到100 dB,单位增益带宽为1 GHz的全差分增益自举跨导运算放大器(OTA)。利用TSMC 0.25μm CMOS工艺,在2.5 V的电源电压下,它可以在4 ns内稳定在最终值的0.05%内。通过仿真优化,该采样保持电路可用于10位,100 MS/s的流水线ADC中。
2021-10-26 21:04:28
93KB
ADC
模数转换器
数字信号
电路
1
adc:模数转换器-matlab开发
adc(range,bits,X) 是一个模数转换函数,即量化,具有可配置的转换上限和下限。 上限和下限可以是不对称的,例如-1到+2,尽管在实际设计中不太可能。 使用 'adc([-2, 3], 8, X)' 将输入向量 X 转换为 -2.0 到 +3.0 之间的有符号 8 位值的向量。
2021-10-13 14:05:41
1KB
matlab
1
ADS7844在低功耗数据采集系统中的应用
详细介绍了12位串行模数转换器ADS7844的结构及工作原理,给出了一个实用的低功耗数据采集系统的设计方案,同时给出了相关的硬件电路和软件程序。
2021-10-07 14:08:53
127KB
串行模数转换器
数据采集系统
低功耗
ADS7844
1
创龙TMS320F2837xD技术参考手册-第10章:
模数转换器(
ADC)
由创龙工程师联合一众电子开发爱好者联合翻译的最新TMS320F2837xD中文翻译数据手册现在可以下载了。您再也不用打开着某某翻译词典,一边翻译,一边忍受着非专业的词汇的痛苦了。 主要围绕TL2837x-EasyEVM是一款基于创龙SOM-TL2837x核心板所设计的高端单/双核浮点开发板,它为用户提供了SOM-TL2837x核心板的测试平台,用于快速评估SOM-TL2837x核心板的整体性能。 TL2837x-EasyEVM底板采用沉金无铅工艺的2层板设计,不仅为客户提供系统驱动源码、丰富的Demo程序、完整的软件开发包,以及详细的TMS320F28x系统开发文档,还协助客户进行底板的开发,提供长期、全面的技术支持,帮助客户以最快的速度进行产品的二次开发,实现产品的快速上市。 TMS320C28x TMS320F2837x 工业核心板 开发板 中文手册 数据手册 创龙 嵌入式 典型运用领域 工业驱动产品 太阳能微型逆变器和转换器 雷达 数字电源 智能抄表 汽车运输 电力线通信 软件定义无线电
2021-10-05 15:49:16
16.48MB
TMS320
创龙
模数转换器(
1
ADC教程_李福乐_清华大学
资源为压缩包,包含有5个PDF文件,从底层基本模块(如:bandgap,LDO,运放)到ADC顶层系统,都有详细讲解,并对很多非理想因素做了独到的见解。
2021-09-23 14:50:03
11.87MB
模数转换器
1
高速ADC系统综述
介绍了7种高速ADC系统(包括闪烁式ADC、折叠插值式ADC、流水线式ADC、Σ-△型ADC、时间交织式ADC系统、基于正交镜像滤波器组的ADC系统和混合滤波器组的ADC系统)的结构、基本原理、采样速率和分辨率,并对其性能进行比较,高速、高分辨率、低功耗是高速ADC系统发展的方向。
2021-09-10 13:47:47
625KB
通信系统
模数转换器
滤波器/数字信号处理器
1
ADI技术指南合集.zip
硬件工程师必看的模拟电路指南合集:ADI技术指南合集-第一版 电路仿真和PCB设计;ADI技术指南合集-第一版 放大器;ADI技术指南合集-第一版 开关电源和基准源;ADI技术指南合集-第一版 模数转换器;ADI技术指南合集-第一版射频和高速器件;数模转换器
2021-08-24 19:37:54
40.9MB
数模转换器
模数转换器
开关电源和基准源
放大器
1
AD/DA转换原理 数模/模数转换器
模拟/数字转换器的详细介绍,可用做教学的课件
2021-08-19 10:11:36
1.47MB
ADC
DAC
模拟
数字
1
TMS320x2802x_Piccolo_模数转换器和比较器参考指南
TMS320x2802x_Piccolo_模数转换器和比较器参考指南,希望这本书对大家有用
2021-08-15 00:21:30
3.87MB
TMS320模数
1
此设计可将Altera FPGA 连接到LVDS 接口模数转换器的起点-电路方案
描述 该参考设计和相关的示例 Verilog 代码可用作将 Altera FPGA 连接到德州仪器 (TI) 高速 LVDS 接口模数转换器 (ADC) 和数模转换器 (DAC) 的起点。其中说明了固件实施并介绍了所需的计时限制。 特性 该设计仅为固件,并进行了详细论述以帮助理解 示例 Verilog 代码是 FPGA 连接到高速数据转换器应用的简单起点 该设计可轻松扩展到其他 TI 高速数据转换器 ADC 和 DAC 部分是分开的,以防只需使用其中一个 详细介绍了有关 DAC 和 ADC 的接口计时限制 已使用现成的 TI EVM 对固件进行了测试
2021-08-10 16:27:55
1.57MB
开源
电路方案
1
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