·1.内容简介： --------------------------------------------------------------- 基于FPGA的自动升降电梯控制器设计 pdf 设计论文 --------------------------------------------------------------- ·2.资源使用方法说明 无 --------------------------------------------------------------- ·3. wogeguaiguai的附言： 1.我的其他数学建模比赛和全国电子设计竞赛精华资源也欢迎您下载，大学生基本上都听过这个比赛吧，这个比赛比较有意思，而且获奖比例高。我的资料都是非常好的准备比赛要用的资料。我比赛结束之后，这些资料就不用啦，分享给大家！俺一年的搜索资源，同学们一朝即可获得！ 2.下载本文件后，您可以获得所有信息，不必再零散下载，给您带来很大的方便。 3.1个资源分，绝对物超所值。评论后，您就可以获得2个资源分，欢迎您评论！ --------------------------------------------------------------- ·4.如有问题，请在此留言，谢谢。 --------------------------------------------------------------- ·65.上传时间 2010-2-26-afternoon

FPGA从0到1学习资料集锦（开发指南+电路图集+例程源码） MOS管驱动电路设计秘籍（工作原理+电路设计+问题总结）

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摘  要：本文为数字电视系统开发的需要实现了基于FPGA与SDRAM的数字信号采集系统。SDRAM可以提供大容量的存储空间。FPGA提供优秀的系统适应能力。该方案通过计算机并口实现FPGA与计算机的通信。关键词：FPGA；SDRAM；采集；数字电视 引言在数字电视系统的设计，开发与调试过程中通常需要对数字化的电视信号进行采集与分析。虽然使用逻辑分析仪可以部分实现此项要求,但是高性能的逻辑分析仪价格昂贵，而且存取深度不足限制了对于海量数字电视信号的分析能力。尽管采用图像采集卡也可以方便地采集到大量的模拟电视图像，但是图像采集卡通常只能保存有效图像内容，行场同步信号将被丢失。而且采集卡使用自身的A

汉明码编译码的FPGA设计与实现方面的文章，对于做FEC(前向纠错)的初学者应该有些帮助。

FPGA实现差错控制编码技术，一篇值得看的论文，值得看。

1 引 言 　　要求改变脉冲周期和输出脉冲个数的脉冲输出电路模块在许多工业领域都有运用。采用数字器件设计周期和输出个数可调节的脉冲发生模块是方便可行的。为了使之具有高速、灵活的优点，本文采用Atelra公司的可编程芯片FPGA设计了一款周期和输出个数可变的脉冲发生器。经过板级调试获得良好的运行效果。 　　2 总体设计思路 　　脉冲的周期由高电平持续时间与低电平持续时间共同构成，为了改变周期，采用两个计数器来分别控制高电平持续时间和低电平持续时间。计数器采用可并行加载初始值的N位减法计数器。设定：当要求的高电平时间以初始值加载到第一个减法器中后，减法器开始减计数，计数到零时自动停止，

Quartus Ⅱ 用户界面 基于QuartusⅡ的FPGA工程概述 综合

单个器件 仅原理图封装 使用需核对引脚

(1).掌握Verilog HDL模块的基本结构。 (2).掌握计数器的设计方法。 (3).掌握基于Quartus II的CPLD/FPGA开发流程。 (4).实验要求完成模24计数器程序设计，并完成Modelsim仿真