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三菱Q系列PLC Q62高速计数器模块应用视频教程.txt
三菱Q系列PLC Q62高速计数器模块应用视频教程 (不需要播放密码,不限制电脑) 是通过百度网盘下载
2021-05-29 09:00:21
263B
Q62高速计数器模块应用视频教
四大常用限流算法原理详解:计数器固定窗口、计数器滑动窗口、漏桶、令牌桶算法.pdf
四大常用限流算法原理详解:计数器固定窗口、计数器滑动窗口、漏桶、令牌桶算法.pdf
2021-05-28 12:02:40
910KB
算法
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电子秒表课程设计设计报告
数电的,利用计数器实行一个电子秒表,在数码管上显示出来,含完整电路图
2021-05-27 09:34:20
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数电
课程设计
电子秒表
计数器
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多个DS18B20测温的proteus仿真电路及C语言程序设计
多个DS18B20测温的proteus仿真电路及C语言程序设计,已经通过调试验证,放心使用
2021-05-26 21:54:53
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DS18B20温度计数器,C语言,51单片机
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100进制计数器
基于quartus ii的100进制计数器vhdl语言
2021-05-25 21:03:19
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100进制
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vhdl
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混合层次化文件设计-十进制可逆计数器.docx
利用verilog实现十进制可逆计数器设计,该设计通过混合层次化文件设计形式,内附程序代码,可直接运行
2021-05-25 16:22:49
15KB
verilog
quartus
计数器
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EDA实验 作业 课程设计,用原理图输入法设计一位全加器,计数器(74160)和译码器(7448),顶层用原理图设计,用混合输入及层次化设计,VHDL语言的组合电路设计,0--9可逆计数器输出的是8421BCD码,交通灯,数字钟
用原理图输入法设计一位全加器,计数器(74160)和译码器(7448),顶层用原理图设计,用混合输入及层次化设计,VHDL语言的组合电路设计,0--9可逆计数器输出的是8421BCD码,交通灯,数字钟的VHDL语言设计
2021-05-25 11:09:44
2.44MB
用原理图输入法设计一位全加器,计数器(74160)和译码器(7448),顶层用原理图设计,用混合输入及层次化设计,VHDL语言的组合电路设计,0--9可逆计数器输出的是8421BCD码,交通灯,数字钟
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第三部分 数字电路实验 触发器构成计数器的方法 中规模集成计数器的使用方法及功能测试方法
第三部分 数字电路实验 1. 学习集成触发器构成计数器的方法。 2. 掌握中规模集成计数器的使用方法及功能测试方法。 3. 用集成电路计数器构成1/N分频器。
2021-05-25 10:36:23
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数字逻辑模6计数器D触发器实现电路
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2021-05-25 09:09:18
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模8计数器vhdl代码
模8计数器vhdl代码
2021-05-25 09:01:40
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