基于FPGA的DDS信号发生器 自己做的一个DDS信号发生器，基本功能实现，下板验证完成，有输出文件，自己只需要改变管脚分配即可使用。工程简介： 1、硬件：Cyclone Ⅳ系列 EP4CE10F17C8 的FPGA芯片；AN9769的数模转化芯片；LCD12864液晶屏显示。 2、软件：基于Quartus Ⅱ，VerilogHDL硬件描述语言。主要有DDS主模块、赋值、按键控制、按键消抖、按键检测、参数选择、波形选择、LCD显示模块、顶层TOP。 3、内容有：01-工程文件、02-硬件连接、03-设计说明、04-参考资料。

逻辑分析仪SignalTaPⅡ在系统级调试中的应用,摘要：嵌入式逻辑分析仪SignalTapII是QuartusII软件中第二代系统级调试工具，它可以用来捕捉目标芯片内部信号节点处的信息，而又不影响原硬件系统的正常工作。通过一个多波形信号发生器的设计实例，详细阐述Signal

基于GABP和改进NSGA-Ⅱ的高速干切滚齿工艺参数多目标优化决策，刘艺繁，阎春平，针对高速干切滚齿过程中的工艺参数优化决策问题，提出一种基于加工工艺样本预测和多目标遗传优化算法的工艺参数优化决策方法。基

集合了Quartus Ⅱ（7.2版本）的常用快捷键，源自软件自带的帮助文档，对于提高软件操作速度有很大的帮助。

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多路彩灯控制器采用VHDL语言编程,在QuartusⅡ4.0上仿真验证功能。通过下载到ALTERA DE2开发板上来实现具体的硬件设计。该设计是一个16路彩灯控制器,可自由选择3种跑马灯花型,具有清零开关,并且可以选择快慢两种节拍。

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CPLD的原理框图如图所示。 　　如图 CPLD的原理框图　　行扫描线由移位寄存器输出驱动，在时钟ck的驱动下移位寄存器工作，同一时间只有一位行线为“0”。列线全部接有内部上拉，在没有键按下的情况下，列线全为“1”。同时与门输出也为“1”，移位寄存器继续工作；当有键按下时，与门输出为低。禁止移位寄存器操作，直到按键被释放。 　　行列编码电路的输出组成键盘的编码输出，输入到处理器。　　此参考设计包括Verilog源代码、Verilog测试文件和.ucf文件。.ucf文件中有关于内部上拉电阻的应用，以及移位寄存器的实现约束的说明。　　CoolRunner-II是低功耗器件适合于电池供电的设各

Ⅱ递归动态球体演示系统 2.1 设计目标 在正八面体的基础上构建球体。正八面体的顶点位于球面上，正八面体的体心设为球心。将正八面体每个正三角形表面的三条边的中点连接形成四个小正三角形，并将三个中点拉伸到球面上。对每个小正三角形进行同样的递归操作可以构造出球体线框模型。请使用不同深度的递归划分法分别绘制无光照线框球，有光照线框球、无光照表面球和有光照表面球。给定沿x，y，z坐标轴3个方向的位移量和绕x，y，z坐标轴的旋转角度，控制球体在窗口客户区内运动。当球体和客户区边界发生碰撞后，改变运动方向。请使用三维正交变换绘制递归动态球体。详细功能要求如下：