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Verilog 编写的基于
VGA
的动画图像显示
用VERILOG编写的代码,在Spartan3E开发板上实验成功,可通过开发板的
VGA
接口将动态的图像在显示屏上显示出来
2020-04-19 15:31:38
66KB
Verilog
VGA FPGA
动画图像
1
VGA
接口及EMC设计标准电路
VGA
接口标准及标准电路设计,网络整理,供参考,共享出来
2020-04-16 03:04:38
96KB
VGA
EMC
电路
1
VESA Signal 1600 x 1200 @ 60 Hz timing.pdf
VGA
视频的1600&1200VESA标准,60HZ,包括行、场信号的视频规范,做
VGA
图像处理必不可少的参考规范。
2020-03-04 03:10:37
165KB
vga
1
基于
VGA
显示 和 PS2键盘,用FPGA控制的贪吃蛇游戏
这是一个基于
VGA
显示 和 PS2键盘,用FPGA控制的贪吃蛇游戏,共设置9关,每关吃21个苹果过关。可按下P(Pause)暂停,暂停过程可以选关,按下G(GO_ON)继续游戏。全程记录分数以及关级。撞墙活撞身体则死!结束后按下空格键继续回到初始状态,否则按下其他键无效
2020-02-10 03:03:41
1.4MB
verilog
FPGA
VGA
贪吃蛇
1
FPGA"打字机" (
VGA
& UART)
用
VGA
和UART在FPGA上实现了一个打字机,挺有意思的
2020-02-05 03:10:50
4.47MB
FPGA;
VGA;
UART
1
Rtmp流生成MP4文件源码
此部分主要对RTMP流进行录制,利用MP4v2将RTMP流封装成MP4,工程debug下的dll文件下载地址https://pan.baidu.com/s/1UlpTfaT4J2SP3zpMcLs0ng,运行工程之前,请先下载dll文件。
2020-01-18 03:30:41
12.31MB
RTMP
FFmepg
MP4V2
VGA
1
基于FPGA,
VGA
和PS2键盘的贪吃蛇游戏(更新成完整的工程)
这是一个基于
VGA
显示和PS2键盘的贪吃蛇游戏进入时屏幕提示“enter to play”,W,S,A,D四 个CS游戏方向键,可按下P(PAUSE)暂停,进入选择关级,然后按下G(GO_ON)继续。游戏设置9关, 每关吃下21个苹果即可过关。蛇的移动速度随着关级增加。
2020-01-15 03:00:32
8.06MB
verilog
fpga
vga
贪吃蛇
1
Phoenix EDID Designer 显示器EDID编辑器
可以对显示器
VGA
EDID, DVI EDID进行编辑,修改,存储,烧录。EDID相关得力工具,免费,绿色,单文件,无需安装。
2020-01-14 03:11:46
202KB
EDID
VGA
1
EDA技术:
VGA
显示控制电路设计(彩条、图片)
实验内容 1、使用Verilog HDL设计一个
VGA
显示控制器,在
VGA
显示器(
VGA
:分辨率:640x480@60Hz)上显示RGB八色彩条。 2、
VGA
显示器(分辨率自定)上显示杭电logo+学号姓名,居中。
2020-01-13 03:16:45
2.87MB
EDA
VGA
QUARTU
1
VGA
行场控制信号分析
介绍了
VGA
行场控制信号中行、场的控制原理和过程
2020-01-08 03:03:45
162KB
VGA
控制
1
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