用Quartus2编的数字时钟 VHDL语言 可以开始停止,清零,调整时间,还会整点报时
2019-12-21 20:27:56 347KB VHDL 数字时钟 Quartus2
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含原理图和仿真图,VHDL语言的交通灯程序的课程设计
2019-12-21 20:27:18 431KB VHDL,交通灯
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基于VHDL语言的出租车计费系统 一个字一个字码出来的课程设计报告 代码全部经过调试了的 可以自己运行 应付课程设计的话 直接改名字就行了!各种截图齐全
2019-12-21 20:24:04 767KB VHDL出租车计费系统
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多种状态机的经典例程 夏尔型,米勒型,带同步复位的等等
2019-12-21 20:21:45 6KB VHGL 状态机例程
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VHDL语言设计实现一个10 秒倒计时电路,要求使用8×8点阵显示计时结果。在QuartusII平台上设计程序和仿真题目要求。之后显示交通灯功能。
2019-12-21 20:19:48 807KB VHDL QuartusII 点阵倒计时 交通灯
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vhdl语言写IIC接口程序
2019-12-21 20:15:00 226KB VHDL FPGA IIC
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用VHDL编写的一个数字下变频,可供参考。
2019-12-21 20:14:46 2KB DDC VHDL FPGA
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EDA实验和毕业设计的同学应该用的到!! 常见的都有
2019-12-21 20:14:27 1.22MB VHDL 仿真
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使用VHDL语言描述BPSK的调制与解调,采用DDS技术产生载波,已调通。
2019-12-21 20:09:24 900B BPSK,VHDL
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数据采集控制系统的设计与分析 设计要求用一片CPLD/FPGA、模数转换器ADC和数模转换器DAC构成一个数据采集系统,并用CPLD/FPGA实现数据采集中对A/D转换、数据运算、D/A转换以及有关数据显示的控制。数据采集和控制系统是对生产过程或科学实验中各种物理量进行实时采集、测试和反馈控制的闭环系统。它在工业控制、军事电子设备、医学监护等许多领域发挥着重要作用。 附加程序代码
2019-12-21 20:05:32 2.12MB 数据采集 FPGA VHDL语言
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