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浙江理工大学 数字电路实验 实验七-时序
逻辑电路
的设计multisim电路模拟
包括D触发器逻辑功能测试1、D触发器逻辑功能测试2、D触发器逻辑功能测试3、利用74LS161设计BCD5421码十进制计数器,multisim模拟电路完全正常
2019-12-21 19:25:48
328KB
浙江理工大学
数电实验
时序逻辑电路
1
数字
逻辑电路
与系统设计课后答案完全版
完全版数字
逻辑电路
与系统设计课后答案(蒋立平版),不在是单号答案,仅供参考学习
2019-12-21 19:24:53
6.33MB
数电课后答案
数电答案
数电
1
数字逻辑基础与verilog设计
本文件为《数字逻辑基础与verilog设计》原书第二版的PDF资源。
2019-12-21 18:53:48
68.17MB
verilog
数字逻辑电路
FPGA
1
数子
逻辑电路
课后习题答案
数字
逻辑电路
张文超主编 高惠芳 任兵 等 编 电子工业出版社
2019-12-21 18:52:57
2.08MB
数字逻辑电路
1
8人抢答器课程设计报告
数字
逻辑电路
课程设计报告,包含multisim10设计的模拟电路,分块设计,功能独立课演示。含有相应截图,顺带数字钟电路参考图,用到的元器件资料以及一个pdf阅读器(打包时没注意,但是元器件资料有些是pdf格式的,方便没有pdf的朋友了)
2019-12-21 18:52:35
12.79MB
8人抢答器
抢答器
课程设计报告
数字逻辑电路
1
VHDL硬件描述语言与数字
逻辑电路
设计(第三版)
硬件电路设计以及在校大学生的有用参考,主要讲述了VHDL硬件描述语言的语法结构,是初学者入门的经典
2014-03-10 00:00:00
24.9MB
VHDL
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