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16位
单周期
CPU设计
使用Verilog实现16位
单周期
CPU的设计
2019-12-21 19:55:59
826KB
单周期CPU
1
单周期
CPU verilog设计代码和仿真代码
单周期
CPU的设计,使用结构级语句与描述级语句构建寄存器堆、ALU、CONUNIT等模块,支持12条指令:add、sub、j、bne、bnq等
2019-12-21 19:52:04
377KB
单周期CPU
veilog仿真
1
北航计组实验代码和电路(二)Logisim
单周期
北航计组p3--Logisim
单周期
--电路最终版 支持30+条指令
2019-12-21 18:58:38
638KB
计算机组成
1
北航计组实验代码(三)p4--Verilog
单周期
北航计组实验p4代码--Verilog
单周期
支持36种指令 附设计文档
2019-12-21 18:58:38
342KB
计算机组成
1
单周期
处理器
Verilog编程下的
单周期
处理器,实现基本的几条指令,
单周期
处理器由数据通路和控制器组成。采用模块化和层次化设计。
2019-12-21 18:56:56
170KB
cpu
verilog
1
logisim搭建32位
单周期
CPU
计算机组成原理作业。Project3。logisim搭建32位
单周期
CPU,支持addu,subu,lui,ori,beq,jal,nop等指令。
2019-12-21 18:56:46
140KB
CPU
1
北航计算机组成实验Project4
Project4 VerilogHDL完成
单周期
处理器开发 适合北航计算机系的学生 1.处理器应 MIPS-Lite3 指令集。 a) MIPS-Lite3={MIPS-Lite2,addi,addiu, slt,j,jal,jr}。 b) MIPS-Lite2 指令集:addu,subu,ori,lw,sw,beq,lui。 c) addi 可以不支持溢出。 2. 处理器为
单周期
设计。
2019-12-21 18:55:54
776KB
北航
计算机组成
Project4
单周期处理器
1
单周期
CPUverilog实现
华科,
单周期
CPUverilog实现,
单周期
CPUverilog实现,可供参考,hhh。
2019-12-21 18:54:37
10KB
CPU
verilog
1
单周期
CPUMIPS32位
单周期
CPU 32位MIPS
单周期
CPU 可以实现16条指令
MIPS32位
单周期
CPU 32位MIPS
单周期
CPU 可以实现16条指令
2019-12-21 18:53:48
19KB
MIPS32位
1
Logisim Mips
单周期
处理器
电路模拟logisim进行mips
单周期
CPU开发,支持的指令集MIPS-Lite:addu,subu,ori,lw,sw,beq,lui,j,sb
2019-12-21 18:53:28
181KB
logisim
mips
1
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