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基于verilog的浮点
运算器
这是一个基于verilog设计的浮点型计算器,里面包括verilog代码,测试代码,PIPELINE的设计
2021-04-01 19:59:51
128KB
浮点运算器
verilog
1
华科 计算机组成原理
运算器
设计(HUST) logisim 全11关
以下十一关,自测100分通过—— 第1关:8位可控加减法电路设计 第2关:CLA182四位先行进位电路设计 第3关:4位快速加法器设计 第4关:16位快速加法器设计 第5关:32位快速加法器设计 第6关:5位无符号阵列乘法器设计 第7关:6位有符号补码阵列乘法器 第8关:乘法流水线设计 第9关:原码一位乘法器设计 第10关:补码一位乘法器设计 第11关:MIPS
运算器
设计
2021-04-01 19:49:46
538KB
计算机组成原理
华科
运算器设计
logisim
1
稀疏矩阵
运算器
.rar
实现任意两个稀疏矩阵的加、减和乘运算和任一稀疏矩阵的转置运算。
2021-04-01 17:01:52
124KB
cpp
c语言
稀疏矩阵
转置运算
1
华科计算机组成原理实验-
运算器
1-11关circ完整文件
Educoder平台,华中科技计算机组成原理实验-
运算器
(HUST),1-11关circ完整文件,自己做的
2021-03-31 15:39:22
724KB
Educoder平台
华中科技计算机组成原理实验
运算器(HUST)
circ完整文件
1
计算机组成原理实验课程 实验一
运算器
设计(加法器设计)8位可控加减法器设计、32位算术逻辑运算单元ALU设计alu.circ
8位可控加减法器设计、32位算术逻辑运算单元ALU设计、四位先行进位74182、四位快速加法器 、8位快速加法器、16位快速加法器、5位阵列乘法、6位补码阵列乘法器等电路,已画好。alu自动测试是100分。
2021-03-30 11:37:57
710KB
logisim
计算机组成原理
实验
1
华中科技大学自己动手画CPU
运算器
设计1-11答案计算机组成原理
8位可控加减法电路设计 CLA182四位先行进位电路设计 4位快速加法器设计 16位快速加法器设计 32位快速加法器设计 5位无符号阵列乘法器设计 6位有符号补码阵列乘法器 乘法流水线设计 原码一位乘法器设计 补码一位乘法器设计 MIPS
运算器
设计
2021-03-29 16:40:41
543KB
答案
logisim
计算机组成原理
自己动手画CPU
1
简单
运算器
设计.zip
利用Proteus数字电路模拟软件制作的简单
运算器
设计。是数字逻辑的课程设计(湖工)。我使用的软件是Proteus 8,需要用这个版本的软件打开,版本7的话是打不开的。
2021-03-28 21:55:53
55KB
数字逻
1
2
运算器
设计实验.rar
运算器
设计实验,可以在logisim平台上运行,将cicr代码复制到EduCoder可以直接通过,华中科技大学谭志虎。本实训项目帮助学生从可控加减法单元,先行进位电路,四位快速加法器逐步构建 16 位、32 位快速加法器。学生还可以设计阵列乘法器,乘法流水线,实现原码一位乘法器,补码一位乘法器、
运算器
等教材上的核心内容。
2021-03-20 19:01:22
28KB
logisim
EduCoder
运算器设计实验
计算机系统实验2
运算器
.zip
这个是
运算器
实验时我所写的vhdl代码和实验日志,基本上比较详尽的记录了我当时的心路过程,在这里上传上来,算是对我当时学习生活的一个记录,日后可以比较方便的进行查看
2021-03-10 21:05:35
2.06MB
嵌入式
计算机系统
1
哈工程模型机课程设计源码
哈工程模型机课程设计,带移位
运算器
的模型机源码电路图。
2021-03-09 18:53:20
3.35MB
哈工程
模型机课程设
源码
带移位运算器
1
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