LM2576 稳压电压模块ALTIUM设计硬件原理图+PCB+文档资料，硬件采用2层板设计，大小为28*41mm,包括完整的原理图和PCB文件，可以做为你的学习设计参考。

基于THB7128步进电机驱动板protel99se设计硬件原理图+PCB源文件（直接拿来可以用）,可以做为你的学习设计参考。

基于THB6128步进电机驱动板protel99se设计硬件（原理图+PCB）,可以做为你的学习设计参考。

MSP430F2617TPM主控可自动调整的24V步进电机设计（AD设计硬件原理图PCB+源代码+BOM）,可以做为你的学习设计参考。

Pciex8金手指接口封装PADS设计硬件原理图库+PCB封装库文件，,可以做为你的学习设计参考。

Pciex8金手指接口封装ALTIUM设计硬件原理图库+PCB封装库文件，,可以做为你的学习设计参考。

压缩文件中有硬件原理图和完整的KEIL程序代码，打开就能下载到STC89C52RC单片机中，各个引脚的连接可以自己重新更改代码选择不同的引脚进行连接

飓风cyclone FPGA开发板verilog逻辑例程Quartus工程源码文件（16例）： low_cost_lcd S1_38yima S2_div S3_WAVE S4_LCD_V S4_LCD_VHDL S5_UART S6_VGA S6_VGA_change S7_PS2_LCD S7_PS2_RS232 S8_test T1_SW_PB T2_USB_IN T3_USB_OUT T4_LED_RUN 1。源文件保存在src目录，QII的工程文件保存在Proj目录； 2。程序可以在VGA显示器上以800x600分辨率显示方波示例和字母示例 3。具体设计参考代码。 `timescale 1ns/1ns module UART_tb; wire tbre; wire tsre; wire sdo ; wire rxd; reg [7:0] din; reg rst ; reg clk16x ; reg wrn; reg rdn; wire [7:0] dout; wire data_ready; wire framing_error ; wire parity_error ; uart PC (.dout(dout), .data_ready(data_ready), .framing_error(framing_error), .parity_error(parity_error), .rxd(rxd), .clk16x(clk16x), .rst(rst), .rdn(rdn), .din(din), .tbre(tbre), .tsre(tsre), .wrn(wrn), .sdo(sdo) ) ; uart_if FPGA (.clk(clk16x), .rst_n(~rst), .txd(rxd), .rxd(sdo) ); // Enter fixture code here initial begin din = 0; rst = 0; clk16x = 0; wrn = 1; rdn = 1; end always #10 clk16x = ~clk16x ; initial begin #3 rst = 1'b1 ; din ="R";// 8'b11110000 ; #5000 rst = 1'b0 ; #30 wrn = 1'b0 ; #150 wrn = 1'b1 ; //#4000 din ="r"; // 8'b10101010 ; //#870 wrn = 1'b0 ; //#200 wrn = 1'b1 ; #104000 din ="r"; // 8'b10101010 ; #870 wrn = 1'b0 ; #200 wrn = 1'b1 ; #104000 $stop; end always @(posedge data_ready) begin #100 rdn=0; #500 rdn=1; end endmodule // Uart_tb

JS7628（WIFI模块）底板开发板ALTIUM设计硬件原理图+PCB封装库文件,可以做为你的学习设计参考。

IP178G设计8端口交换机ALTIUM硬件原理图+PCB+原理图PCB封装库文件,硬件采用4层板设计，大小为118*110mm,包括AD设计的原理图和PCB及封装库文件，可以做为你的学习设计参考。 主要器件有： AMS-1117 AMS1117 AT24C02_0 CAP NP CAP_1 INDUCTOR_0 IP178GA_8 LL4148_0 PE68515_8 PHONEJACK_0 RJ45_Double_san R_1 R_1_Dup1 SW PUSHBUTTON_5 TP XTAL_1