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基于FPGA的8位十进制数字频率计设计.pdf
基于FPGA的8位十进制数字频率计设计.pdf
2021-09-23 11:13:27
341KB
频率计.pdf
1
简易数字频率计.zip
该压缩包是电子技术课程设计源代码,亲手编写。设计对象为频率计数器,主要实现将不同信号的频率值输出到8位动态数码管。该文件包含了8位BCD计数器、锁存器、数码管显示驱动(扫描计数器, 3-8译码器, 8选1数据选择器, BCD7段译码器)、分频器(3分频、4分频、5分频、10分频)等模块。实验开发板是Cyclone II: EP2C8Q208C8。
2021-09-21 16:05:40
1.13MB
fpga
1
verilog 数字频率计设计
采用verilog语言编写,方波输入,频率范围为1-200KHZ
2021-09-17 10:32:58
5.29MB
verilog
数字频率计设计
1
基于VerilogHDL
数字频率计的
设计.pdf
verilog HDL
数字频率计的
设计
2021-09-17 10:23:52
8.4MB
频率计
1
八位十进制
数字频率计的
设计
该仿真的作用是实现十进制计数功能。从仿真图4.13中可以得出,当第一个CNT10计数输出 CQ=9 时,下一秒时钟上升沿到来时,将产生一个CARRY_OUT信号作为下一个CNT10 的时钟信号,同时CQ 清零,依次递推到8个CNT10。
2021-09-15 18:15:56
2.06MB
EDA
1
数电课程设计
数字频率计的
制作
数电课程设计
数字频率计的
制作,详细的介绍了
数字频率计的
制作方法和原理
2021-09-15 14:58:15
541KB
数电课程设计数字频率计的制作
1
数字频率计 程序加电路图 完整版 keil和PROTUES联调通过
数字频率计 程序加电路图 完整版 keil和PROTUES联调通过,非常好用哇
2021-09-14 16:41:42
32KB
数字频率计
程序加电路图
完整版
keil和PROTUES联调通过
1
简易数字频率计设计报告
简易数字频率计设计报告--数字电路课程设计报告
2021-09-14 12:40:05
308KB
简易数字频率计设计报告
1
4位数字频率计Multisim仿真实例
4位数字频率计Multisim仿真实例
2021-09-10 13:02:38
282KB
数字频率计
Multisim仿真
1
倒计时计数计时器数字频率计四位数密码锁_4位抢答器数字钟简易电子琴简易洗衣机等Multisim仿真实例30个
倒计时计数计时器数字频率计四位数密码锁_4位抢答器数字钟简易电子琴简易洗衣机等Multisim仿真实例30个
2021-09-09 13:04:20
18.56MB
Multisim仿真
1
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